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4位共阳数码管动态扫描输出，试着通过单片机控制4位数码管显示1，2，3，4字符
verilog 32位加法器 代码
计数器源程序是用六位数码管显示，可实现正反计数和可选择正反显示，预置数值是以每位独立预置。
Lattice8位处理器Verilog代码实现，可用于其它FPGA
四位全加器的VHDL源代码，可以在Max+PlusII QuartusII测试使用
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