采用现场可编程门阵列(FPGA)可以快速实现数字电路，但是用于生成FPGA编程的比特流文件的CAD工具在编制大规模电路时常常需要数小时的时间，以至于许多设计者甚至通过在给定FPGA上采用更多的资源，或者以牺牲电路速度为代价来提高编制速度。电路编制过程中大部分时间花费在布线阶段，因此有效的布线算法能极大地减少布线时间。 许多布线算法已经被开发并获得应用，其中布尔可满足性(SAT)布线算法及几何查找布线算法是当前最为流行的两种。然而它们各有缺点：基于SAT的布线算法在可扩展性上有很大缺陷；几何查找布线算法虽然具有广泛的拆线重布线能力，但当实际问题具有严格的布线约束条件时，它在布线方案的收敛方面存在很大困难。基于此，本文致力于探索一种能有效解决以上问题的新型算法，具体研究工作和结果可归纳如下。 1、在全面调查FPGA结构的最新研究动态的基础上，确定了一种FPGA布线结构模型，即一个基于SRAM的对称阵列(岛状)FPGA结构作为研究对象，该模型仅需3个适合的参数即能表示布线结构。为使所有布线算法可在相同平台上运行，选择了美国北卡罗来纳州微电子中心的20个大规模电路作为基准，并在布线前采用VPR399对每个电路都生成30个布局，从而使所有的布线算法都能够直接在这些预制电路上运行。 2、详细研究了四种几何查找布线算法，即一种基本迷宫布线算法Lee，一种基于协商的性能驱动的布线算法PathFinder，一种快速的时延驱动的布线算法VPR430和一种协商A
上传时间： 2013-05-18
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在超深亚微米技术工艺下，布局成为超大规模集成电路物理设计中至关重要的一步。由于现场可编程门阵列(Field Programable Gate Array，FPGA)布线资源的预先确定性，使得FPGA的布局更为重要。本文以建立高性能、低拥挤的布局为目标，从FPGA芯片结构和布局算法两方面进行了深入研究。论文提出了一种通用的层次式FPGA(HFPGA)结构模型及布局模型，并且给出了该模型的数学计算公式；提出将元件之间的层次距离转化为线长的方法，实现了基于线网模型的高精度布局算法：提出利用矩形的对角线元件之间层次来代替线长，从而达到优化线长的同时提高布通率的快速布局算法。实验结果表明，两种算法均在北卡罗来纳微电子中心(MCNC)学术芯片测试案例上取得了较理想的布局实验效果，为下一步的布线工作建立了良好的基础接口，并且完成了初始布线的工作。本FPGA结构模型的提出和布局算法的实现也都为工业界提供了借鉴价值。
上传时间： 2013-04-24
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采用FPGA 实现π/ 4 DQPSK调制器--\r\n北 方 交 通 大 学 学 报
上传时间： 2013-08-11
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武汉理工 课设
上传时间： 2013-10-30
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信号完整性问题是高速PCB 设计者必需面对的问题。阻抗匹配、合理端接、正确拓扑结构解决信号完整性问题的关键。传输线上信号的传输速度是有限的，信号线的布线长度产生的信号传输延时会对信号的时序关系产生影响，所以PCB 上的高速信号的长度以及延时要仔细计算和分析。运用信号完整性分析工具进行布线前后的仿真对于保证信号完整性和缩短设计周期是非常必要的。在PCB 板子已焊接加工完毕后才发现信号质量问题和时序问题，是经费和产品研制时间的浪费。1.1 板上高速信号分析我们设计的是基于PowerPC 的主板，主要由处理器MPC755、北桥MPC107、北桥PowerSpanII、VME 桥CA91C142B 等一些电路组成，上面的高速信号如图2-1 所示。板上高速信号主要包括：时钟信号、60X 总线信号、L2 Cache 接口信号、Memory 接口信号、PCI 总线0 信号、PCI 总线1 信号、VME 总线信号。这些信号的布线需要特别注意。由于高速信号较多，布线前后对信号进行了仿真分析，仿真工具采用Mentor 公司的Hyperlynx7.1 仿真软件，它可以进行布线前仿真和布线后仿真。
上传时间： 2013-11-04
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计算机网络是高校计算机专业和大部分理工类非计算机专业必修课，在教学过程中设计实验，让学生动手验证抽象的计算机网络原理，是提高教学质量必不可少的环节，传统的构建计算机网络实验室的方法成本高，师生受时空限制。文中设计并实现了NS-2环境下的以太网络实验，给出了一般实验设计流程，克服了构建真实物理环境实验的成本高、灵活性差等缺点，同时对流程稍作修改，便可设计更多的计算机网络技术实验，具有扩展性强、灵活性高的特点。
上传时间： 2013-12-21
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武汉理工 数控直流源
上传时间： 2013-11-12
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淮南煤矿区地跨淮河两岸，辖有大通、田家庵、谢家集、八公山、潘集5个行政区，人口106．30万，是国家大型煤炭生产基地之一。淮南供电始于民国19年（1930年）4月，当时仅有1台7．5千瓦直流发电机发电，供九龙岗矿场地面照明。民国25年，九龙岗东西两矿，有1路1．70公里的2．3千伏送电线相联，各装1台10千伏安变压器。民国27年后，日本侵略军占领淮南，在大通、九龙岗两区建矿采煤，掠夺煤炭资源，民国32年，建成下窑（田家庵）发电所，架设经大通至九龙岗22千伏同杆（铁塔）双固路输电线，和大通、九龙岗2个变电所，以3．3千伏向矿井配电。抗日战争胜利后，民国36年4月，淮南路矿公司架设田家庵至八公山22千伏输电线。至此22千伏线路全长37．10公里，变电所4个，降压变压器11台，总容量7500千伏安。民国37年售电量1189．60万千瓦·时，主要供煤矿用电。建国后，先后对谢一、谢二、谢三矿和李咀孜矿进行勘探建井。1954年，原22千伏线路和变电所升压为35千伏供电。1958年起以110千伏电压供电。至1972年，发展成为工商业区和政治文化中心的东部地区，也升压为110千伏供电。1975年淮河北岸潘集矿区开始建设，负荷中心北移，由田家庵电厂出线跨越淮河至潘集矿区的110千伏输变电工程同时投运。1978～1982年间，淮南矿区又先后建成田家庵电厂经西山变电所至淮河北岸芦集变电所的220千伏系统。1985年，田家庵、洛河电厂装机总容量达90．10万千瓦，市内供电网相应加强，全矿区已形成主要由田家庵电厂110千伏母线和220千伏西山变电所、芦集变电所3点分片供电，以220千伏和110千伏高压配电网联合供电的格局。同时，一些大型厂矿都有自备35千伏及以上变电所，并向附近中小企业转供电，形成东部田家庵、大通两区，中部望峰岗地区，西部谢集、八公山两区，淮河北岸潘集区组成的4个公用中低压配电网络。1985年，全市最高负荷19．55万千瓦，供电量16亿多千瓦·时。其中，煤炭工业最高负荷9．34万千瓦，用电量4．99亿千瓦·时，占全市用电量的三分之一。
标签： 矿区供电
上传时间： 2013-10-12
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SDRAM的原理和时序 SDRAM内存模组与基本结构 我们平时看到的SDRAM都是以模组形式出现，为什么要做成这种形式呢？这首先要接触到两个概念：物理Bank与芯片位宽。1、 物理Bank 传统内存系统为了保证CPU的正常工作，必须一次传输完CPU在一个传输周期内所需要的数据。而CPU在一个传输周期能接受的数 据容量就是CPU数据总线的位宽，单位是bit（位）。当时控制内存与CPU之间数据交换的北桥芯片也因此将内存总线的数据位宽 等同于CPU数据总线的位宽，而这个位宽就称之为物理Bank（Physical Bank，下文简称P-Bank）的位宽。所以，那时的内存必须要组织成P-Bank来与CPU打交道。资格稍老的玩家应该还记 得Pentium刚上市时，需要两条72pin的SIMM才能启动，因为一条72pin -SIMM只能提供32bit的位宽，不能满足Pentium的64bit数据总线的需要。直到168pin-SDRAM DIMM上市后，才可以使用一条内存开机。不过要强调一点，P-Bank是SDRAM及以前传统内存家族的特有概念，RDRAM中将以通道（Channel）取代，而对 于像Intel E7500那样的并发式多通道DDR系统，传统的P-Bank概念也不适用。2、 芯片位宽 上文已经讲到SDRAM内存系统必须要组成一个P-Bank的位宽，才能使CPU正常工作，那么这个P-Bank位宽怎么得到呢 ？这就涉及到了内存芯片的结构。 每个内存芯片也有自己的位宽，即每个传输周期能提供的数据量。理论上，完全可以做出一个位宽为64bit的芯片来满足P-Ban k的需要，但这对技术的要求很高，在成本和实用性方面也都处于劣势。所以芯片的位宽一般都较小。台式机市场所用的SDRAM芯片 位宽最高也就是16bit，常见的则是8bit。这样，为了组成P-Bank所需的位宽，就需要多颗芯片并联工作。对于16bi t芯片，需要4颗（4×16bit=64bit）。对于8bit芯片，则就需要8颗了。以上就是芯片位宽、芯片数量与P-Bank的关系。P-Bank其实就是一组内存芯片的集合，这个集合的容量不限，但这个集合的 总位宽必须与CPU数据位宽相符。随着计算机应用的发展，
上传时间： 2013-11-04
上传用户：zhuimenghuadie
交通灯控制器的设计与实现一、实验目的1． 了解交通灯管理的基本工作原理。2． 熟悉8253计数器/定时器、8259A中断控制器和8255A并行接口的工作方式及应用编程。3． 掌握多位LED显示的方法。 二、 实验内容与要求设计一个用于十字路口的交通灯控制器。1．基本要求： 1) 东西和南北方向各有一组红,黄,绿灯用于指挥交通,红,黄,绿的持续时间分别为25s,5s,20s。2) 当有紧急情况（如消防车）时，两个方向均为红灯亮，计时停止，当特殊情况结束后，控制器恢复原来状态，正常工作。3) 一组数码管，以倒计时方式显示两个方向允许通行或禁止通行的时间。2．提高部分：1) 实时修改交通灯的持续时间。2) 根据不同时段对主要交通方向的信号进行调整。3) 可以使用LCD显示提示信息。 三、实验报告要求 １．设计目的和内容 ２．总体设计 ３．硬件设计：原理图（接线图）及简要说明 ４．软件设计框图及程序清单 ５．设计结果和体会（包括遇到的问题及解决的方法） 四、总体设计交通灯的工作过程如下：设十字路口的1、3为南，北方向，2、4为东西方向，初始态为4个路口的红灯全亮。之后，1、3路口的绿灯亮，2、4路口的红灯亮，1、3路口方向通车，2个路口的LED数码管开始倒计时25秒。延迟20秒后，1、3路口的绿灯熄灭，而1，3路口的黄灯开始闪烁（1HZ）。闪烁5次后，1、3路口的红灯亮，同时2、4路口的绿灯亮，2、4路口方向开始通车，2个路口的LED数码管重新开始倒计时25秒。延迟20秒时间后，2、4路口的绿灯熄灭，而黄灯开始闪烁。闪烁5次后，再切换到1、3路口方向。之后，重复上述过程。当有紧急情况时，2个方向都红灯亮，倒计时停止，车辆禁止通行，当紧急情况结束后，控制器恢复以前的状态继续工作。 在设计中采用6个发光二极管来模拟2个路口的黄红绿灯，每个路口用2个数码管来显示通行或禁止剩余的时间。紧急情况用一个单脉冲发生单元申请中断来模拟，紧急情况结束后，再发一个中断来恢复以前的状态。 根据前面的介绍，本设计硬件由定时模块、发光二极管模块、数码管显示模块和紧急中断模块组成。定时模块采用硬件定时和软件定时相结合的方法，用8253定时/计数器定时100ms，再用软件计时实现所需的定时。发光二极管模块由8255控制发光二极管来实现。数码管显示模块由实验平台上的LED显示模块实现。紧急中断模块是由单脉冲发生单元和8279中断控制器组成。 程序主要是由定时子程序、发光二极管显示子程序、数码管显示子程序和中断服务程序组成。包括对8253、8255以及8259等可编程器件的编程。 五、硬件设计 本课题的设计可通过实验平台上的一些功能模块电路组成，由于各模块电路内部已经连接，用户在使用时只要设计模块间电路的连接，因此，硬件电路的设计及实现相对简单。完整系统的硬件连接如图1所示。硬件电路由定时模块、发光二极管模块、数码管显示模块和紧急中断模块组成。 定时模块是由8253的计数器0来实现定时100ms。Clk0接实验平台分频电路输出Q6，f＝46875hz。GATE0接8255的PA0，由8255输出来控制计数器的起停。OUT0接8259的IRQ2，定时完成申请中断，进入中断服务程序。 发光二极管显示模块由8255输出来控制发光二极管的亮灭。8255输出为低电平时，对应的发光二极管就点亮，否则就熄灭。8255的接口电路如图2所示。交通灯的对应关系如下：L7 L6 L5 L2 L1 L0PC7 PC6 PC5 PC2 PC1 PC013红灯 13黄灯 13绿灯 24红灯 24黄灯 24绿灯 实验平台上提供一组六个LED数码管。插孔CS1用于数码管段选的输出选通，插孔CS2用于数码管位选信号的输出选通。本设计用4个数码管来倒计时。 紧急中断模块是由单脉冲发生单元和8259中断控制器，单脉冲发生单元主要用来请求中断，然后做出紧急情况处理。
标签： 交通灯控制器
上传时间： 2013-10-07
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