由于绝缘栅双极晶体管IGBT具有工作频率高、处理功率大和驱动简单等诸多优点,在电力电子设备、尤其是中大型功率的电力电子设备中的应用越来越广泛。但是,IGBT失效引发的设备故障往往会对生产带来巨大影响和损失,因此,对IGBT的失效研究具有十分重要的应用意义。 本文在深入分析IGBT器件工作原理和工作特性的基础上,采用双极传输理论联立求解电子和空穴的传输方程,得到了稳态时电子和空穴电流的表达式,对造成IGBT失效的各种因素进行了详细分析。应用MATLAB软件,对硅参数的热导率、载流子浓度、载流子寿命、电子迁移率、空穴迁移率和双极扩散系数等进行了仿真,深入研究了IGBT的失效因素,得到了IGBT失效的主要原因是发生擎住效应以及泄漏电流导致IGBT延缓失效的有用结论。并且,进行了IGBT动态模型的设计和仿真,对IGBT在短路情况下的失效机理进行了深入研究。 考虑到实际设备中的IGBT在使用中经常会发生反复过流这一问题,通过搭建试验电路,着重对反复过流对IGBT可能带来的影响进行了试验研究,探讨了IGBT因反复过流导致的累积失效的变化规律。本文研究结果对于正确判断IGBT失效以及失效程度、进而正确判断和预测设备的可能故障,具有一定的应用参考价值。
上传时间: 2013-08-04
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本文以高频链逆变器为被控对象,在推导出被控对象的动态模型后,提出一种新型控制方案:即内环电流环采用混合型PI--模糊控制策略,外环电压环采用PI控制策略的瞬时值双闭环控制方案。
上传时间: 2014-08-18
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为了减少电力电子装置对电网引起的谐波污染,在变频器接入电网之前加入PFC电路是一种趋势。讨论了基于TMS320LF2407的全数字控制的单相PFC电路的工作原理,并由此得到了主电路参数的选取原则;建立了单相Boost型数字PFC的小信号动态模型,并分析了基于该模型的数字控制设计方法,给出了设计软件流程;最后搭建了一台样机,在实际电路中实现了数字控制的单相PFC,并得到了较好的实验结果。
上传时间: 2014-12-28
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Verilog_HDL的基本语法详解(夏宇闻版):Verilog HDL是一种用于数字逻辑电路设计的语言。用Verilog HDL描述的电路设计就是该电路的Verilog HDL模型。Verilog HDL既是一种行为描述的语言也是一种结构描述的语言。这也就是说,既可以用电路的功能描述也可以用元器件和它们之间的连接来建立所设计电路的Verilog HDL模型。Verilog模型可以是实际电路的不同级别的抽象。这些抽象的级别和它们对应的模型类型共有以下五种: 系统级(system):用高级语言结构实现设计模块的外部性能的模型。 算法级(algorithm):用高级语言结构实现设计算法的模型。 RTL级(Register Transfer Level):描述数据在寄存器之间流动和如何处理这些数据的模型。 门级(gate-level):描述逻辑门以及逻辑门之间的连接的模型。 开关级(switch-level):描述器件中三极管和储存节点以及它们之间连接的模型。 一个复杂电路系统的完整Verilog HDL模型是由若干个Verilog HDL模块构成的,每一个模块又可以由若干个子模块构成。其中有些模块需要综合成具体电路,而有些模块只是与用户所设计的模块交互的现存电路或激励信号源。利用Verilog HDL语言结构所提供的这种功能就可以构造一个模块间的清晰层次结构来描述极其复杂的大型设计,并对所作设计的逻辑电路进行严格的验证。 Verilog HDL行为描述语言作为一种结构化和过程性的语言,其语法结构非常适合于算法级和RTL级的模型设计。这种行为描述语言具有以下功能: · 可描述顺序执行或并行执行的程序结构。 · 用延迟表达式或事件表达式来明确地控制过程的启动时间。 · 通过命名的事件来触发其它过程里的激活行为或停止行为。 · 提供了条件、if-else、case、循环程序结构。 · 提供了可带参数且非零延续时间的任务(task)程序结构。 · 提供了可定义新的操作符的函数结构(function)。 · 提供了用于建立表达式的算术运算符、逻辑运算符、位运算符。 · Verilog HDL语言作为一种结构化的语言也非常适合于门级和开关级的模型设计。因其结构化的特点又使它具有以下功能: - 提供了完整的一套组合型原语(primitive); - 提供了双向通路和电阻器件的原语; - 可建立MOS器件的电荷分享和电荷衰减动态模型。 Verilog HDL的构造性语句可以精确地建立信号的模型。这是因为在Verilog HDL中,提供了延迟和输出强度的原语来建立精确程度很高的信号模型。信号值可以有不同的的强度,可以通过设定宽范围的模糊值来降低不确定条件的影响。 Verilog HDL作为一种高级的硬件描述编程语言,有着类似C语言的风格。其中有许多语句如:if语句、case语句等和C语言中的对应语句十分相似。如果读者已经掌握C语言编程的基础,那么学习Verilog HDL并不困难,我们只要对Verilog HDL某些语句的特殊方面着重理解,并加强上机练习就能很好地掌握它,利用它的强大功能来设计复杂的数字逻辑电路。下面我们将对Verilog HDL中的基本语法逐一加以介绍。
标签: Verilog_HDL
上传时间: 2013-11-23
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Verilog_HDL的基本语法详解(夏宇闻版):Verilog HDL是一种用于数字逻辑电路设计的语言。用Verilog HDL描述的电路设计就是该电路的Verilog HDL模型。Verilog HDL既是一种行为描述的语言也是一种结构描述的语言。这也就是说,既可以用电路的功能描述也可以用元器件和它们之间的连接来建立所设计电路的Verilog HDL模型。Verilog模型可以是实际电路的不同级别的抽象。这些抽象的级别和它们对应的模型类型共有以下五种: 系统级(system):用高级语言结构实现设计模块的外部性能的模型。 算法级(algorithm):用高级语言结构实现设计算法的模型。 RTL级(Register Transfer Level):描述数据在寄存器之间流动和如何处理这些数据的模型。 门级(gate-level):描述逻辑门以及逻辑门之间的连接的模型。 开关级(switch-level):描述器件中三极管和储存节点以及它们之间连接的模型。 一个复杂电路系统的完整Verilog HDL模型是由若干个Verilog HDL模块构成的,每一个模块又可以由若干个子模块构成。其中有些模块需要综合成具体电路,而有些模块只是与用户所设计的模块交互的现存电路或激励信号源。利用Verilog HDL语言结构所提供的这种功能就可以构造一个模块间的清晰层次结构来描述极其复杂的大型设计,并对所作设计的逻辑电路进行严格的验证。 Verilog HDL行为描述语言作为一种结构化和过程性的语言,其语法结构非常适合于算法级和RTL级的模型设计。这种行为描述语言具有以下功能: · 可描述顺序执行或并行执行的程序结构。 · 用延迟表达式或事件表达式来明确地控制过程的启动时间。 · 通过命名的事件来触发其它过程里的激活行为或停止行为。 · 提供了条件、if-else、case、循环程序结构。 · 提供了可带参数且非零延续时间的任务(task)程序结构。 · 提供了可定义新的操作符的函数结构(function)。 · 提供了用于建立表达式的算术运算符、逻辑运算符、位运算符。 · Verilog HDL语言作为一种结构化的语言也非常适合于门级和开关级的模型设计。因其结构化的特点又使它具有以下功能: - 提供了完整的一套组合型原语(primitive); - 提供了双向通路和电阻器件的原语; - 可建立MOS器件的电荷分享和电荷衰减动态模型。 Verilog HDL的构造性语句可以精确地建立信号的模型。这是因为在Verilog HDL中,提供了延迟和输出强度的原语来建立精确程度很高的信号模型。信号值可以有不同的的强度,可以通过设定宽范围的模糊值来降低不确定条件的影响。 Verilog HDL作为一种高级的硬件描述编程语言,有着类似C语言的风格。其中有许多语句如:if语句、case语句等和C语言中的对应语句十分相似。如果读者已经掌握C语言编程的基础,那么学习Verilog HDL并不困难,我们只要对Verilog HDL某些语句的特殊方面着重理解,并加强上机练习就能很好地掌握它,利用它的强大功能来设计复杂的数字逻辑电路。下面我们将对Verilog HDL中的基本语法逐一加以介绍。
标签: Verilog_HDL
上传时间: 2014-12-04
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变色龙层次聚类算法,利用动态模型的层次聚类算法
上传时间: 2015-04-03
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kalman滤波,系统方程主要采用动态模型的例程
上传时间: 2014-11-14
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硕士学位论文捷联惯性系统初始对准研究 惯导系统的初始对准是影响系统使用性能的关键技术之一,对准的精度与速度直接关系到惯性统的精度与启动特性。对卡尔曼滤波及其在初始对准中的应用进行了研究。首先介绍了卡尔曼滤波理论的应用背景,然后推导了离散卡尔曼滤波方程,并对连续系统的状态方程进行离散化提出了适用于舰载捷联惯性系统的动基座对准的2通道10个状态变量和2通道12个状态变量的系统动态模型,并建了相应的速度匹配和位置匹配量测模型。
上传时间: 2013-12-26
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UML概述,通用模型元素,用例模型,建立静态和动态模型
标签: UML
上传时间: 2013-12-15
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研究软件体系结构的首要问题是如何表示软件体系结构,即如何对软件体系结构建模。根据建模的侧重点的不同,可以将软件体系结构的模型分为5种:结构模型、框架模型、动态模型、过程模型和功能模型。
标签: 软件体系结构
上传时间: 2013-12-17
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