分区设计
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CPLD_FPGA设计经验分享
在数字电路的设计中，时序设计是一个系统性能的主要标志，在高层次设计方法中，对时序控制的抽象度也相应提高，因此在设计中较难把握，但在理解RTL电路时序模型的基础上，采用合理的设计方法在设计复杂数字系统是行之有效的，通过许多设计实例证明采用这种...
2015-10-08
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频谱分析仪设计
一般测试仪器由信号采集、信号处理和结果显示三大部分组成[2]，这三部分均由硬件构成。虚拟仪器也是由这三大部分组成，但是除了信号采集部分是由硬件实现之外，其他两部分都是由软件实现的。在本设计中，用LabVIEW中的信号发生控件来代替信号采集部...
2022-09-09
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