《分频器设计》绝对好用的EDA实验程序!已经通过测试。VHDL语言编写
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全数字调制解调器设计的matlab程序 有CIC FIR等滤波器...
基于fpga的JPEG编解码器设计,采用流水线优化解决时间并行性问题,提高DCT/IDCT模块的运行速度。...
基于FPGA的分频器设计,已经通过了仿真(VHDL语言编写)...
加减运算 毕业设计 文档加代码...
并行AVS实时编解码器设计与实现 介绍了一种并行AVS实时编码器的设计,它包括音视频数据输入、音视频编码、传输流系统复用器、输出和控制部分,其 中重点介绍了视频编码器和传输流系统复用器的设计和实现...
加减时间计数器设计,经过实际使用通过测试。...
这是一个FPGA的BCD码编码器设计.编译后可以下载到ALTEA的器件中仿真....
基于PLD的RS码编译码器设计,用VHDL语言编写,编译通过,测试结果正确。...
包含了模式识别中常用的一些分类器设计算法,并且还能根据参数指定样本的分布规律,然后通过分类算法找分界面...