在ISE中直接调用chipscope进行在线逻辑分析
上传时间： 2013-11-15
上传用户：thing20
使用Quartus II Timequest时序分析器约束分析设计
上传时间： 2013-11-12
上传用户：yy_cn
首先介绍了采用直接数字频率合成（DDS）技术的正弦信号发生器的基本原理和采用FPGA实现DDS信号发生器的基本方法，然后结合DDS的原理分析了采用DDS方法实现的正弦信号发生器的优缺点，其中重点分析了幅度量化杂散产生的误差及其原因，最后针对DDS原理上存在的幅度量化杂散，利用FPGA时钟频率可调的特点，重点提出了基于FPGA实现的DDS正弦信号发生器的两种改进方法，经过MATLAB仿真验证，改进方法较好的抑制了幅度量化杂散，减小了误差。
上传时间： 2013-10-09
上传用户：ssj927211
时序分析的好资料
标签： 时序分析
上传时间： 2013-11-07
上传用户：hustfanenze
信号完整性 分析 新手入门知识
上传时间： 2013-10-18
上传用户：wanqunsheng
电子发烧友网核心提示：Altera公司昨日宣布，在业界率先在28 nm FPGA器件上成功测试了复数高性能浮点数字信号处理（DSP）设计。独立技术分析公司Berkeley设计技术有限公司（BDTI）验证了能够在 Altera Stratix V和Arria V 28 nm FPGA开发套件上简单方便的高效实现Altera浮点DSP设计流程，同时验证了要求较高的浮点DSP应用的性能。本文是BDTI完整的FPGA浮点DSP分析报告。 Altera的浮点DSP设计流程经过规划，能够快速适应可参数赋值接口的设计更改，其工作环境包括来自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高级模块库，支持FPGA设计人员比传统HDL设计更迅速的实现并验证复数浮点算法。这一设计流程非常适合设计人员在应用中采用高性能 DSP，这些应用包括，雷达、无线基站、工业自动化、仪表和医疗图像等。
上传时间： 2014-12-28
上传用户：18888888888
设计工程师通常在FPGA上实现FIFO(先进先出寄存器)的时候，都会使用由芯片提供商所提供的FIFO。但是，由于其通用性使得其针对性变差，某些情况下会变得不方便或者将增加硬件成本。此时，需要进行自行FIFO设计。本文提供了一种基于信元的FIFO设计方法以供设计者在适当的时候选用。这种方法也适合于不定长包的处理。
上传时间： 2014-01-13
上传用户：mengmeng444425
在分析和比较现有电力测温技术的基础上，从标签的选用和读卡器的设计两方面介绍了一种新型的射频监控系统的设计方案,重点介绍了系统在Window CE操作系统下的软件功能的设计，并给出了系统软件设计的整体流程图。
上传时间： 2013-11-18
上传用户：ouyang426
基于Android智能操作系统开发平台，以移动通信网为载体，利用短信方式和GPRS方式实现在系统客户端信息采集与传输、进行数据分析处理等功能的物联网无线测控系统。用户通过Android设备终端，可以随时随地查看环境数据并进行实时检测与控制，实现物联网嵌入式的无线测控功能。
上传时间： 2013-10-23
上传用户：qitiand
基于Android手机操作系统开发了一款自发短信系统。利用SQLite数据库存储技术、Service启动服务技术及Runnable接口，设计并实现了好友管理、短信管理、后台检测发送短信等功能，并给出了运行效果图。该系统的实现为指定时间发送定制短信提供了很大的方便性。
上传时间： 2013-11-29
上传用户：lunshaomo
