作业集

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Verilog作业 ：自己写的源码输入，补码输出的，由状态机控制的四位加法器，为保证时序，加法器模块为超前近位加法器，包含测试台，通过 Modelsim 、Synplify仿真。

2014-01-21 96 作业集

《微机系统与接口》课程作业(2009-2010) （标清题号 无须抄题）  习题一（第 1 章）       1．写出下列二进制数的原码、反码和补码（设字长为 8 位）...

2017-05-23 2 作业集

该文档为工业无人机项目合作方案讲解文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………

2022-01-20 3 作业集