二阶锁相环Matlab仿真代码,如入两路信号和信噪比,输出锁相以后的信号。可以仿真初始频差,和频率斜升的情况
上传时间: 2015-05-14
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7400 2输入端四与非门 7401 集电极开路2输入端四与非门 7402 2输入端四或非门 7403 集电极开路2输入端四与非门 7404 六反相器 7405 集电极开路六反相器 7406 集电极开路六反相高压驱动器 7407 集电极开路六正相高压驱动器 7408 2输入端四与门 7409 集电极开路2输入端四与门 7410 3输入端3与非门 74107 带清除主从双J-K触发器 74109 带预置清除正触发双J-K触发器 7411 3输入端3与门 74112 带预置清除负触发双J-K触发器 7412 开路输出3输入端三与非门 74121 单稳态多谐振荡器 74122 可再触发单稳态多谐振荡器 74123 双可再触发单稳态多谐振荡器 74125 三态输出高有效四总线缓冲门 74126 三态输出低有效四总线缓冲门 7413 4输入端双与非施密特触发器 74132 2输入端四与非施密特触发器 74133 13输入端与非门 74136 四异或门 74138 3-8线译码器/复工器 74139 双2-4线译码器/复工器 7414 六反相施密特触发器 74145 BCD—十进制译码/驱动器 7415 开路输出3输入端三与门 74150 16选1数据选择/多路开关 74151 8选1数据选择器 74153 双4选1数据选择器 74154 4线—16线译码器
上传时间: 2014-01-10
上传用户:jackgao
AT89C51是一种带4K字节闪烁可编程可擦除只读存储器(FPEROM—Falsh Programmable and Erasable Read Only Memory)的低电压,高性能CMOS8位微处理器,俗称单片机。该器件采用ATMEL高密度非易失存储器制造技术制造,与工业标准的MCS-51指令集和输出管脚相兼容。由于将多功能8位CPU和闪烁存储器组合在单个芯片中,ATMEL的AT89C51是一种高效微控制器,为很多嵌入式控制系统提供了一种灵活性高且价廉的方案。
标签: Programmable Erasable FPEROM Memory
上传时间: 2015-09-05
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DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低.
标签: signal_out signal_in DPLL 模
上传时间: 2013-12-26
上传用户:希酱大魔王
仿真了锁相环工作到一定时间后达到锁定状态的过程,程序采用的是一阶RC低通滤波器即二阶一型环
上传时间: 2016-02-25
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第一部分 概论 第一章 仿真的作用 第二章 仿真方法论 第二部分 基本概念与方法 第三章 采样与量化 第四章 带通信号与系统的低通仿真模型 第五章 滤波器模型与仿真方法 第六章 案例研究:锁相环与微分方程方法 第七章 随机信号的产生与处理 第八章 后处理 第九章 蒙特卡罗方法导论 第十章 通信系统的蒙特卡罗仿真 第十一章无线系统仿真的方法论 第三部分 第十二章非线性系统的建模与仿真 第十三章时变系统的建模与仿真 第十四章波形信道的建模与仿真 第十五章离散信道模型 第十六章高效仿真技术 第十七章案例研究:蜂窝无线通信系统的仿真 第十八章仿真实例
上传时间: 2014-01-18
上传用户:csgcd001
LVD电源低电检测等程序,是数码相框必需的步骤
上传时间: 2016-04-21
上传用户:亚亚娟娟123
本程序使用MSP430F149控制IIC总线EEProm AT24C02;MCU的通用输入输出(GPIO)端口P1.2、P1.3 与AT24C02 的SCL、SDA端口相连接构成I2C总线,因为MSP430F149 内部没有专用的I2C接口电路,所以只能用IO端口来模拟I2C时序从而实现对EEPROM的读写操作。从图 3.3 中我们可以看到EEPROM地址选择端口A0~A2 都外接低电平,所以进行I2C通信时,EEPROM的从机地址是唯一的,即A0~A2 所对应的地址控制位均为 0。 因为AT24C0X(X=1,2,4,8,16)系列芯片的管脚是兼容的,所以用户也可以自行更换其他型号的芯片,无需改动任何硬件结构,只需注意器件地址和存储空间寻址模式的变化,相应地修改软件程序即可。
上传时间: 2014-01-09
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介绍了一种基于锁频锁相环(FPLL)的载波跟踪算法。频率跟踪模块可以适应较大动态范围的频率变化,基于软件的数控振荡器(NCO)模块可以达到极高的频率跟踪精度。由于有锁频环的频率牵引,锁相环路滤波器可以设计得很窄,具有很好的抑噪性能,满足精确跟踪载波相位的要求。因此,该基于FPLL的载波跟踪算法可以适应信号存在较大的动态范围和噪声干扰的应用环境;同时,其鉴频鉴相算法表达式简单,易于用可编程数字器件实现。
上传时间: 2014-01-23
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一种低噪声可变增益放大器。文中介绍了以AD603 为核心构成的低噪声可变增益放大器的实用电路, 通过模式选择、 引脚编程, 可选择不同的带宽, 以及得到不同的增益。通过对增益控制方式的选择, 可得到最佳的信 噪比。
上传时间: 2016-10-05
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