近年来，以电池作为电源的微电子产品得到广泛使用，因而迫切要求采用低电源电压的模拟电路来降低功耗。目前低电压、低功耗的模拟电路设计技术正成为微电子行业研究的热点之一。 在模拟集成电路中，运算放大器是最基本的电路，所以设计低电压、低功耗的运算放大器非常必要。在实现低电压、低功耗设计的过程中，必须考虑电路的主要性能指标。由于电源电压的降低会影响电路的性能，所以只实现低压、低功耗的目标而不实现优良的性能(如高速)是不大妥当的。 论文对国内外的低电压、低功耗模拟电路的设计方法做了广泛的调查研究，分析了这些方法的工作原理和各自的优缺点，在吸收这些成果的基础上设计了一个3.3 V低功耗、高速、轨对轨的CMOS/BiCMOS运算放大器。在设计输入级时，选择了两级直接共源一共栅输入级结构；为稳定运放输出共模电压，设计了共模负反馈电路，并进行了共模回路补偿；在偏置电路设计中，电流镜负载并不采用传统的标准共源-共栅结构，而是采用适合在低压工况下的低压、宽摆幅共源-共栅结构；为了提高效率，在设计时采用了推挽共源极放大器作为输出级，输出电压摆幅基本上达到了轨对轨；并采用带有调零电阻的密勒补偿技术对运放进行频率补偿。 采用标准的上华科技CSMC 0.6μpm CMOS工艺参数，对整个运放电路进行了设计，并通过了HSPICE软件进行了仿真。结果表明，当接有5 pF负载电容和20 kΩ负载电阻时，所设计的CMOS运放的静态功耗只有9.6 mW，时延为16.8ns，开环增益、单位增益带宽和相位裕度分别达到82.78 dB，52.8 MHz和76°，而所设计的BiCMOS运放的静态功耗达到10.2 mW，时延为12.7 ns，开环增益、单位增益带宽和相位裕度分别为83.3 dB、75 MHz以及63°，各项技术指标都达到了设计要求。
标签： CMOSBiCMOS 低压 低功耗
上传时间： 2013-06-29
上传用户：saharawalker
在特定的工业测控应用中对处理器的功耗有严格的要求，类似X86处理器芯片系列由于继承了原有8086的构架，功耗很大，不能满足要求。当前应用广泛的ARM系列处理器有低功耗、高处理器能力的优点，非常适合于此类应用。由于ARM处理器并没有对PC/104总线有支持，所以本设计使用CPLD可编程逻辑完成ARM本地总线与PC/104总线的转换。文章完成了以下工作： 1.介绍了工业控制计算机的发展情况和当前使用广泛的PC/104计算机，描述了嵌入式系统的发展历史和软硬件组成，分析了X86与ARM处理器构架的特点与优缺点； 2.从PC/104总线规范出发，对基于ARM处理器的PC/104工业控制嵌入式工控机进行了总体设计，软硬件选型部分对当前流行的软硬件系统进行了详细地描写，硬件处理器选用SAMSUNG公司的S3C2410，软件系统采用嵌入式Linux操作系统； 3.对系统硬件各个部分实现细节进行了描写，包括最小系统、CAN网络、以太网络和PC/104总线控制器；其中着重对PC/104总线控制器的实现方案进行了讨论，分析了ARM本地总线时序和PC/104总线时序，最后使用VHDL语言实现了了总线控制器逻辑； 4.移植了嵌入式Linux操作系统，Linux操作系统移植分为配置、编译和下载运行调试三个步骤；基于Linux操作系统编写了PC/104总线驱动，驱动完成映射PC/104地址到系统虚拟地址和中断绑定；编写了基于PC/104的CAN总线驱动，分析了驱动初始化、中断处理流程、数据缓冲区管理和文件操作接口，描写了驱动的编译和下载过程；最后给出了应用程序接口； 5.根据机车工业控制领域的具体要求，开发了实际系统，给出了系统主要参数指标；对系统的运算性能进行了测试，测试表明定点运算能力与X86相当，符合设计要求：系统通过铁标高低温测试和射频干扰测试，并进行了为期3个月的装车试运行，试运行过程中系统工作正常，完全能够满足设计要求。
上传时间： 2013-07-10
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加密算法一直在信息安全领域起着无可替代的作用,它直接影响着国家的未来和发展.随着密码分析水平、芯片处理能力和计算技术的不断进步,原有的数据加密标准(DES)算法及其变形的安全强度已经难以适应新的安全需要,其实现速度、代码大小和跨平台性均难以继续满足新的应用需求.在未来的20年内,高级加密标准(AES)将替代DES成为新的数据加密标准.高级加密标准算法是采用对称密钥密码实现的分组密码,支持128比特分组长度及128比特、192比特与256比特可变密钥长度.无论在反馈模式还是在非反馈模式中使用AES算法,其软件和硬件对计算环境的适应性强,性能稳定,密钥建立时间优良,密钥灵活性强.存储需求量低,即使在空间有限的环境使用也具备良好的性能.在分析高级加密标准算法原理的基础上,描述了圈变换及密钥扩展的详细编制原理,用硬件描述语言(VHDL)描述了该算法的整体结构和算法流程.详细论述了分组密码的两种运算模式(反馈模式和非反馈模式)下算法多种体系结构的实现原理,重点论述了基本体系结构、循环展开结构、内部流水线结构、外部流水线结构、混合流水线结构及资源共享结构等.最后在XILINX公司XC2S300E芯片的基础上,采用自顶向下设计思想,论述了高级加密标准算法的FPGA设计方法,提出了具体模块划分方法并对各个模块的实现进行了详细论述.圈变换采用内部流水线结构,多个圈变换采用资源共享结构,密钥调度与加密运算并行执行.占用芯片面积及引脚资源较少,在芯片选型方面具有很好的适应性.
上传时间： 2013-06-20
上传用户：fairy0212
ASIC对产品成本和灵活性有一定的要求.基于MCU方式的ASIC具有较高的灵活性和较低的成本,然而抗干扰性和可靠性相对较低,运算速度也受到限制.常规ASIC的硬件具有速度优势和较高的可靠性及抗干扰能力,然而不是灵活性较差,就是成本较高.与传统硬件(CHW)相比,具有一定可配置特性的场可编程门阵列(FPGA)的出现,使建立在可再配置硬件基础上的进化硬件(EHW)成为智能硬件电路设计的一种新方法.作为进化算法和可编程器件技术相结合的产物,可重构FPGA的研究属于EHW的研究范畴,是研究EHW的一种具体的实现方法.论文认为面向分类的专用类可重构FPGA(ASR-FPGA)的研究,可使可重构电路粒度划分的针对性更强、设计更易实现.论文研究的可重构FPGA的BCH通讯纠错码进化电路是一类ASR-FPGA电路的具体方法,具有一定的实用价值.论文所做的工作主要包括:(1)BCH编译码电路的设计——求取实验用BCH码的生成多项式和校验多项式及其相应的矩阵并构造实验用BCH码;(2)建立基于可重构FPGA的基核——构造具有可重构特性的硬件功能单元,以此作为可重构BCH码电路的设计基础;(3)构造实现可重构BCH纠错码电路的方法——建立可重构纠错码硬件电路算法并进行实验验证;(4)在可重构纠错码电路基础上,构造进化硬件控制功能块的结构,完成各进化RLA控制模块的验证和实现.课题是将可重构BCH码的编译码电路的实现作为一类ASR-FPGA的研究目标,主要成果是根据可编程逻辑电路的特点,选择一种可编程树的电路模型,并将它作为可重构FPGA电路的基核T;通过对循环BCH纠错码的构造原理和电路结构的研究,将基核模型扩展为能满足纠错码电路需要的纠错码基本功能单元T;以T作为再划分的基本单元,对FPGA进行"格式化",使T规则排列在FPGA上,通过对T的控制端的不同配置来实现纠错码的各个功能单元;在可重构基核的基础上提出了纠错码重构电路的嵌套式GA理论模型,将嵌套式GA的染色体串作为进化硬件描述语言,通过转换为相应的VHDL语言描述以实现硬件电路;采用RLA模型的有限状态机FSM方式实现了可重构纠错码电路的EHW的各个控制功能块.在实验方面,利用Xilinx FPGA开发系统中的VHDL语言和电路图相结合的设计方法建立了循环纠错码基核单元的可重构模型,进行循环纠错BCH码的电路和功能仿真,在Xilinx公司的Virtex600E芯片进行了FPGA实现.课题在研究模型上选取的是比较基本的BCH纠错码电路,立足于解决基于可重构FPGA核的设计的基本问题.课题的研究成果及其总结的一套ASR-FPGA进化硬件电路的设计方法对实际的进化硬件设计具有一定的实际指导意义,提出的基于专用类基核FPGA电路结构的研究方法为新型进化硬件的器件结构的设计也可提供一种借鉴.
上传时间： 2013-07-01
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今天，电视机与视讯转换盒应用中的大多数调谐器采用的都是传统单变换MOPLL概念。这种调谐器既能处理模拟电视讯号也能处理数字电视讯号，或是同时处理这两种电视讯号(即所谓的混合调谐器)。在设计这种调谐器时需考虑的关键因素包括低成本、低功耗、小尺寸以及对外部组件的选择。本文将介绍如何用英飞凌的MOPLL调谐芯片TUA6039-2或其影像版TUA6037实现超低成本调谐器参考设计。这种单芯片ULC调谐器整合了射频和中频电路，可工作在5V或3.3V，功耗可降低34%。设计采用一块单层PCB，进一步降低了系统成本，同时能处理DVB-T/PAL/SECAM、ISDB-T/NTSC和ATSC/NTSC等混合讯号，可支持几乎全球所有地区标准。图1为采用TUA6039-2/TUA6037设计单变换调谐器架构图。该调谐器实际上不仅是一个射频调谐器，也是一个half NIM，因为它包括了中频模块。射频输入讯号透过一个简单的高通滤波器加上中频与民间频段(CB)陷波器的组合电路进行分离。该设计没有采用PIN二极管进行频段切换，而是采用一个非常简单的三工电路进行频段切换。天线阻抗透过高感抗耦合电路变换至已调谐的输入电路。然后透过英飞凌的高增益半偏置MOSFET BF5030W对预选讯号进行放大。BG5120K双MOSFET可以用于两个VHF频段。在接下来的调谐后带通滤波器电路中，则进行信道选择和邻道与影像频率等多余讯号的抑制。前级追踪陷波器和带通滤波器的容性影像频率补偿电路就是专门用来抑制影像频率。
上传时间： 2013-11-19
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LY6206系列是一款高精度,低功耗,3引脚LDO高电压调整器芯片,并采用CMOS工艺和激光微调技术. 在输出电流较大的情况下,输入输出压差也能很小。 LY6206系列芯片内部包括一个电流限制电路,一个驱动三极管,一个高精度参考电压源和一个误差校正电路,可使用低ESR陶瓷电容.电流限制器的foldback电路可为电流限制器和输出引脚提供短路保护。通过激光微调技术,可设定芯片的输出电压,其范围是1.2V至5.0V,间隔100mV,输出电压1.2V-3.6V封装SOT23-3/SOT23-5/SOT89-3
上传时间： 2013-11-15
上传用户：thuyenvinh
本书分三部分介绍在美国广泛应用的、高功能的M68HC11系列单片机(8位机 ，Motorola公司)。内容包括Ｍ６８HC１１的结构与其基本原理、开发工具EVB(性能评估板)以及开发和应用技术。本书在介绍单片机硬、软件的基础上，进一步介绍了在美国实验室内，如何应用PC机及EVB来进行开发工作。通过本书的介绍，读者可了解这种单片机的原理并学会开发和应用方法。本书可作为大专院校单片机及其实验的教材(本科、短训班)。亦可供开发、应用单片机的各专业(计算机、机电、化工、纺织、冶金、自控、航空、航海……)有关技术人员参考。 第一部分 M68HC11 结构与原理Motorola单片机 1 Motorla单片机 1.1 概述 1.1.1 Motorola 单片机发展概况(3) 1.1.2 Motorola 单片机结构特点(4) 1.2 M68HC11系列单片机(5) 1.2.1 M68HC11产品系列(５) 1.2.2 MC68HC11E9特性(６) 1.2.3 MC68HC11E9单片机引脚说明(８) 1.3 Motorola 32位单片机(１４) 1.3.1中央处理器(CPU32)(１５) 1.3.2 定时处理器(TPU)(１６) 1.3.3 串行队列模块(QSM)(１６) 1.3.4 系统集成模块 (SIM)(１６) 1.3.5 RAM(１７) 2 系统配置与工作方式 2.1 系统配置(１９) 2.1.1 配置寄存器CONFIG(１９) 2.1.2 CONFIG寄存器的编程与擦除(２０) 2?2 工作方式选择(２１) 2.3 M68HC11的工作方式(２３) 2.3.1 普通单片工作方式(２３) 2.3.2 普通扩展工作方式(２３) 2.3.3 特殊自举方式(２７) 2.3.4 特殊测试方式(２８) 3 中央处理器(CPU)与片上存储器 3.1 CPU寄存器(３１) 3?1?1 累加器A、B和双累加器D(３２) 3.1.2 变址寄存器X、Y(３２) 3.1.3 栈指针SP(３２) 3.1.4 程序计数器PC(３３) 3.1.5 条件码寄存器CCR(３３) 3.2 片上存储器(３４) 3.2.1 存储器分布(３４) 3.2.2 RAM和INIT寄存器(３５) 3.2.3 ROM(３７) 3.2.4 EEPROM(３７) 3.3 M68HC11 CPU的低功耗方式(３９) 3.3.1 WAIT方式(３９) 3.3.2 ＳＴＯP方式(４０) 4 复位和中断 4.1 复位(４１) 4.1.1 M68HC11的系统初始化条件(４１) 4.1.2 复位形式(４３) 4.2 中断(４８) 4.2.1 条件码寄存器CCR中的中断屏蔽位(４８) 4.2.2 中断优先级与中断矢量(４９) 4.2.3 非屏蔽中断(５２) 4.2.4 实时中断(５３) 4.2.5 中断处理过程(５６) 5 M68HC11指令系统 5.1 M68HC11寻址方式(５９) 5.1.1 立即寻址(IMM)(５９) 5.1.2 扩展寻址(EXT)(６０) 5.1.3 直接寻址(DIR)(６０) 5.1.4 变址寻址(INDX、INDY)(６１) 5.1.5 固有寻址(INH)(６２) 5.1.6 相对寻址(REL)(６２) 5.1.7 前置字节(６３) 5.2 M68HC11指令系统(６３) 5.2.1 累加器和存储器指令(６３) 5.2.2 栈和变址寄存器指令(６８) 5.2.3 条件码寄存器指令(６９) 5.2.4 程序控制指令(７０) 6 输入与输出 6.1 概述(７３) 6.2 并行I／O口(７４) 6.2.1 并行I／O寄存器(７４) 6.2.2 应答I／O子系统(７６) 6?3 串行通信接口SCI(８２) 6.3.1 基本特性(８３) 6.3.2 数据格式(８３) 6.3.3 SCI硬件结构(８４) 6.3.4 SCI寄存器(８６) 6.4 串行外围接口SPI(９２) 6.4.1 SPI特性(９２) 6.4.2 SPI引脚信号(９２) 6.4.3 SPI结构(９３) 6.4.4 SPI寄存器(９５) 6.4.5 SPI系统与外部设备进行串行数据传输(９９) 7 定时器系统与脉冲累加器 7.1 概述(１０５) 7.2 循环计数器(１０７) 7.2.1 时钟分频器(１０７) 7.2.2 计算机正常工作监视功能(１１０) 7.2.3 定时器标志的清除(１１０) 7.3 输入捕捉功能(１１１) 7.3.1 概述(１１１) 7.3.2 定时器输入捕捉锁存器(TIC1、TIC2、TIC3) 7.3.3 输入信号沿检测逻辑(１１３) 7.3.4 输入捕捉中断(１１３) 7.4 输出比较功能(１１４) 7.4.1 概述(１１４) 7.4.2 输出比较功能使用的寄存器(１１６) 7.4.3 输出比较示例(１１８) 7.5 脉冲累加器(１１９) 7.5.1 概述(１１９) 7.5.2 脉冲累加器控制和状态寄存器(１２１) 8 A／Ｄ转换系统 8.1 电荷重新分布技术与逐次逼近算法(１２５) 8.1.1 基本电路(１２５) 8.1.2 A／D转换逐次逼近算法原理(１３０) 8.2 M68HC11中Ａ／Ｄ转换的实现方法(１３１) 8.2.1 逐次逼近Ａ／Ｄ转换器(１３１) 8.2.2 控制寄存器(１３２) 8.2.3 系统控制逻辑(１３５)? 9 单片机的内部操作 9.1 用立即> 图书前言 美国Motorola公司从80年代中期开始推出的M68HC11系列单片机是当今功能最强、性能／价格比最好的八位单片微计算机之一。在美国，它已被广泛地应用于教学和各种工业控制系统中。? 该单片机有丰富的I／O功能，完善的系统保护功能和软件控制的节电工作方式 。它的指令系统与早期Motorola单片机MC6801等兼容，同时增加了91条新指令。其中包含16位乘法、除法运算指令等。 为便于用户开发和应用M68HC11单片机，Motorola公司提供了多种开发工具。M68HC11 EVB (Evaluation Board)性能评估板就是一种M68HC11系列单片机的廉价开发工具。它既可用来 调试用户程序，又可在仿真方式下运行。为方便用户，M68HC11 EVB可与IBM?PC连接 ，借助于交叉汇编、通信程序等软件，在IBM?PC上调试程序。? 本书分三部分(共15章)介绍了M68HC11的结构和基本原理、开发工具-EVB及开发应用实例等。第一部分（１～９章），介绍M68HC11的结构和基本原理。包括概述，系统配置与工作方式、CPU和存储器、复位和中断、指令系统、I／Ｏ、定时器系统和脉冲累加器、Ａ／Ｄ转换系统、单片机的内部操作等。第二部分(１０～１１章)，介绍M68HC11 EVB的原理和技术特性以及EVB的应用。第三部分(１２～１５章)，介绍M68HC11的开发与应用技术。包括基本的编程练习、应用程序设计、接口实验、接口设计及应用等。 读者通过学习本书，不仅可了解M68HC11的硬件、软件，而且可了解使用EVB开发和应用M68HC11单片机的方法。在本书的第三部分专门提供了一部分实验和应用程序。? 本书系作者张宁作为高级访问学者，应邀在美国马萨诸塞州洛厄尔大学(University of Massachusetts Lowell)工作期间完成的。全书由张宁执笔。在编著过程中，美国洛厄尔大学的R·代克曼教授?(Professor Robert J. Dirkman)多次与张宁一起讨论、研究，并提供部分资料及实验数据。参加编写和审校等工作的还有王云霞、孙晓芳、刘安鲁、张籍、来安德、张杨等同志。? 为将M68HC11系列单片机尽快介绍给我国，美国Motorola公司的Terrence M.S.Heng先生曾大力支持本书的编著和出版。在此表示衷心感谢。
上传时间： 2013-10-27
上传用户：rlgl123
来自日本东京，韩国首尔，美国德克萨斯普莱诺，2009年12月10日—MICROTUNE,INC.今日发布一款基于最新高集成硅技术的标准射频-基带芯片，此款芯片以极具吸引力的价格提供出色的电视接收性能。MT3141单芯片为全球电视制造商在下一代数字电视设计中引入高性能、低成本、超小型的接收器，从而使他们能够提供所有品牌、型号、价格和屏幕尺寸的超薄超轻的高性能数字电视产品。
上传时间： 2013-10-23
上传用户：xitai
目 录 ADI处理器简介 ADI嵌入式处理器产品系列2 市场和应用. 3 技术短训班与大学计划 . 4 在线培训 可视化学习与开发. 5 开发工具 CROSSCORE开发工具 . . 7 VisualDSP++集成开发环境 8 扩展的开发工具产品 . 12 CROSSCORE 开发工具选型表 13 Blackfin和SHARC处理器的软件模块 . 14 其它支持 第三方开发计划. . 16 平台与参考设计 . 16 EngineerZone 16 基准. . 17 产品介绍和选型表 Blackfin处理器家族 . . 20 Blackfin处理器家族选型表 . . 22 ADSP-BF504/ADSP-BF504F/ADSP-BF506F . 26 ADSP-BF512/ADSP-BF514/ADSP-BF516/ADSP-BF518 . . 28 ADSP-BF522/ADSP-BF523/ADSP-BF524/ADSP-BF525/ ADSP-BF526/ADSP-BF527 . . 30 ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ ADSP-BF549 32 ADSP-BF538/ADSP-BF538F . 34 ADSP-BF536/ADSP-BF537 . . 35 ADSP-BF534 37 ADSP-BF561 38 ADSP-BF531/ADSP-BF532 . . 39 ADSP-BF533 41 ADSP-BF535 43 SHARC处理器家族 44 SHARC处理器家族选型表 46 ADSP-21483/ADSP-21486/ADSP-21487/ADSP-21488/ ADSP-21489 48 ADSP-21478/ADSP-21479 . . 50 ADSP-21467/ADSP-21469 . . 52 ADSP-21371/ADSP-21375 . . 54 ADSP-21367/ADSP-21368/ADSP-21369 55 ADSP-21366 57 ADSP-21363/ADSP-21364 . . 58 ADSP-21266 59 ADSP-21262 60 ADSP-21261 61 ADSP-21161N . . 62 ADSP-21160 63 ADSP-21065L . . 64 SigmaDSP音频处理器 66 SigmaStudio. 66 SigmaDSP产品选型表 . 67 AD1940/AD1941 68 ADAU1401A . 69 ADAU1442/ADAU1445/ADAU1446 . . 70 ADAU1701/ADAU1702 . . 72 ADAU1761 . . 73 ADAU1781 . . 74 SigmaStudio. 75 SigmaDSP评估板 . . 76 TigerSHARC处理器家族 . . 77 TigerSHARC处理器家族选型表 . . 77 ADSP-TS203 78 ADSP-TS202 79 ADSP-TS201 80 ADSP-TS101 81 ADI补充处理器指南 监控器件与数字信号处理器 82 电源管理与数字信号处理器 84 低功耗立体声音频编解码器 86 单声道低功耗D类音频放大器 . . 86 立体声低功耗D类音频放大器 . . 86 多通道编解码器. . 87
上传时间： 2013-11-05
上传用户：金苑科技
PCF8563 是低功耗的CMOS 实时时钟／日历芯片，它提供一个可编程时钟输出，一个中断输出和掉电检测器，所有的地址和数据通过I2C 总线接口串行传递。最大总线速度为400Kbits/s，每次读写数据后，内嵌的字地址寄存器会自动产生增量。
上传时间： 2013-10-19
上传用户：奇奇奔奔
