随机序列发生器,是一个m序列,生成函数都写在里面,位宽为4,可以改变!
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本人根据opencores.org上的cordic算法改写的可配置位宽的cordic算法,并且在原始的级联型的基础上编写的循环(iterative)型的cordic,可通过generic配置。带一个不...
完整的基于ROM查找表的NCO 产生10位宽的正交信号...
8位深,9位宽FIFO VHDL源码设计,如需改进可在此基础上扩展...
现代的计算机追求的是更快的速度、更高的数据完整性和灵活性。无论从物理性能,还是从电气性能来看,现今的并行总线都已出现了某些局限,无法提供更高的数据传输率。而SATA以其传输速率快、支持热插拔、可靠的数...
在现代电子系统中,数字化已经成为发展的必然趋势,接收机数字化是电子系统数字化中的一项重要内容,对数字化接收机的研究具有重要的意义。随着数字化理论和微电子技术的迅速发展,高速的中频数字化接收机的实现已经...
verilog实现一个AGC模块,信号输入位宽16位,通过统计64个输入完成其功率的统计,然后根据功率大小对信号进行缩放。...
基于高速数字信号处理器(DSP) 和大规模现场可编程门阵列( FPGA) ,成功地研制了小型\\r\\n化、低功耗的实时视频采集、处理和显示平台. 其中的DSP 负责图像处理,其外围的全部数字逻辑功能...
AD9880中的色彩空间转换矩阵(CSC)是一个3 × 3矩阵,可提供矩阵中所有系数下的完全编程能力。每个系数均为12位宽,以保持信号完整性。CSC可在高达150 MHz的速度下运行,...
高速数据转换器评估平台(HSDCEP)是基于PC的平台,提供评估Maxim RF数/模转换器(RF-DAC,支持更新速率≥ 1.5Gsps)和Maxim数字上变频器(DUC)的齐全工具。HS...