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8位加法器的实现,非流水线结构,很不错。我测试过,效率比较高
maxplus做的四位乘法器,可下载仿真
VHDL实现四位全加器,适合初学者,源程序下载
VHDL——N位加法器设计
8位计数器的程序,CYPRESS公司生产的PSOC
基于C语言实现的4位全加器逻辑,支持按键控制LED与数码管显示。采用模块化设计,融合SOPC架构思想,具备良好的可移植性与扩展性。
128位的地址译码器,在cpld或者fpga上实现兼可
相位分频器源代码,正确,测试通过
8位加法器的实现,仿真通过,并且包括仿真文件,在quartusii7.1下调试通过
4位乘法器的完整源代码,适用于数字逻辑设计学习与实践,包含基础运算逻辑实现,适合初学者理解乘法器工作原理及硬件描述语言应用。
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