目前对数字化音频处理的具体实现主要集中在以DSP或专用ASIC芯片为核心的处理平台的开发方面，存在着并行处理性能差，系统升级和在线配置不灵活等缺点。另一方面现有解决方案的设计主要集中于处理器芯片，而对于音频编解码芯片的关注度较低，而且没有提出过从芯片层到PCB板层的完整设计思路。本文针对上述问题对数字化音频处理平台进行了研究，主要内容包括： 1、提出了基于FPGA的通用音频处理平台，该方案有别于现有的基于MCU、DSP和其它专用ASIC芯片的方案，论证了基于FPGA的音频处理系统的结构及设计工作流程，并对嵌入式音频处理系统专门进行了研究。 2、提出了从芯片层到PCB板层的完整设计思路，并将设计思路得以实现。完成了FPGA的设计及实现过程，包括：系统整体分析，设计流程分析，配置模块和数据通信模块的RTL实现等；解决了FPGA与音频编解码芯片TLV320AIC23B之间接口不匹配问题；给出配置和数据通信模块的功能方框图；从多个角度完善PCB板设计，给出了各个系统组成部分的详细设计方案和硬件电路原理图，并附有PCB图。 3、建立了实验和分析环境，完成了各项实验和分析工作，主要包括：PCB板信号完整性分析和优化，FPGA系统中各个功能模块的实验与分析等。实验和分析结果论证了系统设计的合理性和实用性。 本文的研究与实现工作通过实验和分析得到了验证。结果表明，本文提出的由FPGA和音频编解码芯片TLV320AIC23B组成的数字化音频处理系统完全可以实现音频信号的数字化处理，从而可以将FPGA在数字信号处理领域的优点充分发挥于音频信号处理领域。
上传时间： 2013-04-24
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可配置端口电路是FPGA芯片与外围电路连接关键的枢纽，它有诸多功能：芯片与芯片在数据上的传递(包括对输入信号的采集和输出信号输出)，电压之间的转换，对外围芯片的驱动，完成对芯片的测试功能以及对芯片电路保护等。 本文采用了自顶向下和自下向上的设计方法，依据可配置端口电路能实现的功能和工作原理，运用Cadence的设计软件，结合华润上华0.5μm的工艺库，设计了一款性能、时序、功耗在整体上不亚于xilinx4006e[8]的端口电路。主要研究以下几个方面的内容： 1.基于端口电路信号寄存器的采集和输出方式，本论文设计的端口电路可以通过配置将它设置成单沿或者双沿的触发方式[7]，并完成了Verilog XL和Hspiee的功能和时序仿真，且建立时间小于5ns和保持时间在0ns左右。和xilinx4006e[8]相比较满足设计的要求。 2.基于TAP Controller的工作原理及它对16种状态机转换的控制，对16种状态机的转换完成了行为级描述和实现了捕获、移位、输出、更新等主要功能仿真。 3.基于边界扫描电路是对触发器级联的构架这一特点，设计了一款边界扫描电路，并运用Verilog XL和Hspiee对它进行了功能和时序的仿真。达到对芯片电路测试设计的要求。 4.对于端口电路来讲，有时需要将从CLB中的输出数据实现异或、同或、与以及或的功能，为此本文采用二次函数输出的电路结构来实现以上的功能，并运用Verilog XL和Hspiee对它进行了功能和时序的仿真。满足设计要求。 5.对于0.5μm的工艺而言，输入端口的电压通常是3.3V和5V，为此根据设置不同的上、下MOS管尺寸来调整电路的中点电压，将端口电路设计成3.3V和5V兼容的电路，通过仿真性能上已完全达到这一要求。此外，在输入端口处加上扩散电阻R和电容C组成噪声滤波电路，这个电路能有效地抑制加到输入端上的白噪声型噪声电压[2]。 6.在噪声和延时不影响电路正常工作的范围内，具有三态控制和驱动大负载的功能。通过对管子尺寸的大小设置和驱动大小的仿真表明：在实现TTL高电平输出时，最大的驱动电流达到170mA，而对应的xilinx4006e的TTL高电平最大驱动电流为140mA[8]；同样，在实现CMOS高电平最大驱动电流达到200mA,而xilinx4006e的CMOS驱动电流达到170[8]mA。 7.与xilinx4006e端口电路相比，在延时和面积以及功耗略大的情况下，本论文研究设计的端口电路增加了双沿触发、将输出数据实现二次函数的输出方式、通过添加译码器将配置端口的数目减少的新的功能，且驱动能力更加强大。
上传时间： 2013-07-20
上传用户：顶得柱
FPGA(Field Programmable Gate Arrays)是目前广泛使用的一种可编程器件，FPGA的出现使得ASIC(Application Specific Integrated Circuits)产品的上市周期大大缩短，并且节省了大量的开发成本。目前FPGA的功能越来越强大，满足了目前集成电路发展的新需求，但是其结构同益复杂，规模也越来越大，内部资源的种类也R益丰富，但同时也给测试带来了困难，FPGA的发展对测试的要求越来越高，对FPGA测试的研究也就显得异常重要。 本文的主要工作是提出一种开关盒布线资源的可测性设计，通过在FPGA内部加入一条移位寄存器链对开关盒进行配置编程，使得开关盒布线资源测试时间和测试成本减少了99％以上，而且所增加的芯片面积仅仅在5％左右，增加的逻辑资源对FPGA芯片的使用不会造成任何影响，这种方案采用了小规模电路进行了验证，取得了很好的结果，是一种可行的测试方案。 本文的另一工作是采用一种FPGA逻辑资源的测试算法对自主研发的FPGA芯片FDP250K的逻辑资源进行了严格、充分的测试，从FPGA最小的逻辑单元LC开始，首先得到一个LC的测试配置，再结合SLICE内部两个LC的连接关系得到一个SLICE逻辑单元的4种测试配置，并且采用阵列化的测试方案，同时测试芯片内部所有的逻辑单元，使得FPGA内部的逻辑资源得完全充分的测试，测试的故障覆盖率可达100％，测试配置由配套编程工具产生，测试取得了完满的结果。
上传时间： 2013-06-11
上传用户：唐僧他不信佛
JPEG 2000是为适应不断发展的图像压缩应用而出现的新的静止图像压缩标准，小波变换是JEPG 2000核心算法之一。小波变换是一种可达到时(空)域或频率域局部化的时频域或空频域分析方法，其多尺度分解特性符合人类的视觉机制，更加适用于图像信息的处理。提升小波变换是一类不采用傅立叶变换做为主要分析工具的小波变换新方法，提升小波变换的提出大大简化了小波变换的计算，使其在实时信号处理领域得到广泛的应用。通过提升的方法很容易构造一般的整数小波变换，由于图像一般用位数较低的整数表示，整数小波变换可以将为整数序列的图像矩阵映射成整数小波系数矩阵，这就大大简化了小波变换的硬件电路设计。在当今数字化和信息化时代背景下，研究具有高速硬件处理功能的可变程逻辑器件在图像压缩算法领域的应用已经成为当今研究的热点。 本文旨在探讨和研制基于FPGA的小波变换模块的可能性和方法。本文采用Xilinx公司的Spartan-Ⅲ系列芯片，根据JPEG 2000推荐无损提升小波算法和有损提升小波算法，设计图像压缩系统的小波变换模块。主要工作如下： 第一部分介绍了传统小波分析理论和提升小波分析理论。包括连续小波时频局域性的特征，离散小波变换系数的意义，多分辨分析引出的构造小波基的系统方法和计算离散小波的快速算法等。重点放在介绍正交小波和双正交小波的构造方法，并介绍了数字图像在小波域的特点。讨论了提升小波变换的基本思想，讨论了用提升方法构造小波基以及传统小波变换的提升实现，讨论了整数小波变换。 第二部分介绍了FPGA结构及其设计流程。介绍了FPGA/CPLD器件的特征、发展趋势及FPGA/CPLD基本结构，然后重点介绍了本文用到的Xilinx公司Spartan-Ⅲ系列芯片的结构特点，以及Xilinx的FPGA开发软件ISE，最后介绍了硬件描述语言VHDL语言的特点。 最后一部分是本论文研究的主要内容，即JPEG 2000中最核心的算法-提升格式小波变换的一维变换模块设计和二维变换模块设计。一维提升小波变换模块采用两种不同的电路结构进行设计-低速低功耗的串行流水线结构和高速高功耗的并行阵列结构。同样，二维小波变换模块也采用了两种不同的电路结构进行设计-低速低功耗的折叠结构和高速高功耗的串行结构。 文章对提升小波变换的FPGA实现中的大量细节问题进行了讨论，给出了每种结构提升小波变换模块的电路原理图，并对原理图进行了仿真测试，仿真测试结果不仅表明了模块功能的正确性，而且表明不同小波模块可以满足相应领域的实际要求。
上传时间： 2013-06-08
上传用户：dwzjt
当前，在系统级互连设计中高速串行I/O技术迅速取代传统的并行I/O技术正成为业界趋势。人们已经意识到串行I/O“潮流”是不可避免的，因为在高于1Gbps的速度下，并行I/O方案已经达到了物理极限，不能再提供可靠和经济的信号同步方法。基于串行I/O的设计带来许多传统并行方法所无法提供的优点，包括：更少的器件引脚、更低的电路板空间要求、减少印刷电路板（PCB）层数、PCB布局布线更容易、接头更小、EMI更少，而且抵抗噪声的能力也更好。高速串行I/O技术正被越来越广泛地应用于各种系统设计中，包括PC、消费电子、海量存储、服务器、通信网络、工业计算和控制、测试设备等。迄今业界已经发展出了多种串行系统接口标准，如PCI Express、串行RapidIO、InfiniBand、千兆以太网、10G以太网XAUI、串行ATA等等。 Aurora协议是为私有上层协议或标准上层协议提供透明接口的串行互连协议，它允许任何数据分组通过Aurora协议封装并在芯片间、电路板间甚至机箱间传输。Aurora链路层协议在物理层采用千兆位串行技术，每物理通道的传输波特率可从622Mbps扩展到3.125Gbps。Aurora还可将1至16个物理通道绑定在一起形成一个虚拟链路。16个通道绑定而成的虚拟链路可提供50Gbps的传输波特率和最大40Gbps的全双工数据传输速率。Aurora可优化支持范围广泛的应用，如太位级路由器和交换机、远程接入交换机、HDTV广播系统、分布式服务器和存储子系统等需要极高数据传输速率的应用。 传统的标准背板如VME总线和CompactPCI总线都是采用并行总线方式。然而对带宽需求的不断增加使新兴的高速串行总线背板正在逐渐取代传统的并行总线背板。现在，高速串行背板速率普遍从622Mbps到3.125Gbps，甚至超过10Gbps。AdvancedTCA（先进电信计算架构）正是在这种背景下作为新一代的标准背板平台被提出并得到快速的发展。它由PCI工业计算机制造商协会（PICMG）开发，其主要目的是定义一种开放的通信和计算架构，使它们能被方便而迅速地集成，满足高性能系统业务的要求。ATCA作为标准串行总线结构，支持高速互联、不同背板拓扑、高信号密度、标准机械与电气特性、足够步线长度等特性，满足当前和未来高系统带宽的要求。 采用FPGA设计高速串行接口将为设计带来巨大的灵活性和可扩展能力。Xilinx Virtex-IIPro系列FPGA芯片内置了最多24个RocketIO收发器，提供从622Mbps到3.125Gbps的数据速率并支持所有新兴的高速串行I/O接口标准。结合其强大的逻辑处理能力、丰富的IP核心支持和内置PowerPC处理器，为企业从并行连接向串行连接的过渡提供了一个理想的连接平台。 本文论述了采用Xilinx Virtex-IIPro FPGA设计传输速率为2.5Gbps的高速串行背板接口，该背板接口完全符合PICMG3.0规范。本文对串行高速通道技术的发展背景、现状及应用进行了简要的介绍和分析，详细分析了所涉及到的主要技术包括线路编解码、控制字符、逗点检测、扰码、时钟校正、通道绑定、预加重等。同时对AdvancedTCA规范以及Aurora链路层协议进行了分析， 并在此基础上给出了FPGA的设计方法。最后介绍了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT设计工具，可在标准ATCA机框内完成单通道速率为2.5Gbps的全网格互联。
上传时间： 2013-05-29
上传用户：frank1234
本文提出了一种适合于嵌入式SoC的USB器件端处理器的硬件实现结构。并主要研究了USB器件端处理器的RTL级实现及FPGA原型验证、和ASIC实现研究，包括从模型建立、算法仿真、各个模块的RTL级设计及仿真、FPGA的下载测试和ASIC的综合分析。它的速度满足预定的48MHz，等效门面积不超过1万门，完全可应用于SOC设计中。 本文重点对嵌入式USB器件端处理器的FPGA实现作了研究。为了准确测试本处理器的运行情况，本文应用串口传递测试数据入FPGA开发板，测试模块读入测试数据，发送入PC机的主机端。通过NI-VISA充当软件端，检验测试数据的正确。
上传时间： 2013-07-24
上传用户：1079836864
随着经济的发展，生活节奏的加快以及信息技术的进步，人们越来越多的借助高性能的移动手持设备来完成日常工作，目前手持设备处理性能有了很大的提高，其所能处理的数据量也越来越大，传统的文件系统管理数据方式已经越来越满足不了需求，嵌入式数据库就随之诞生，为手持设备提供专业的数据管理。嵌入式数据库的轻量级、被软件产品包含、无需人工数据库管理等特点使其适合被应用于各类嵌入式系统及手持设备中。使用嵌入式数据库与使用文件系统进行客户端数据管理相比更加灵活方便、可以高效地实时更新客户端本地数据。使用数据库完成大量数据的存储和管理，同图形界面软件结合构成嵌入式系统应用开发的支撑系统。 SQLite数据库作为一种开源的嵌入式数据库，具有体积小，速度快，存储量大，API使用方便等诸多的优点，目前已经成为被广泛应用的嵌入式数据库之一。同样的，嵌入式图形界面MINIGUI的开源版本也具有体积小，控件比较丰富，编程难度不高等优点，受到广大嵌入式开发者的喜爱。 本文的主要任务是将MINIGUI和SQLite进行有针对的裁剪或添加部分功能后移植到开发板上，然后将图形界面和数据库相结合在arm—linux平台上建立一个具有基本功能的嵌入式信息管理系统。首先分析了系统所使用的硬件平台并研究了软件环境的搭建过程，包括移植Bootloader、移植linux内核、建立NFS网络文件系统进行程序调试，然后分别给出了嵌入式图形界面MINIGUI和嵌入式数据库SQLite移植到开发板的过程和它们各自的开发技术，最后详细研究了如何在MINIGUI中连接SQLite数据库，从而将二者结合起来编程以实现本系统并给出了系统在开发过程中所遇到的关键问题的解决方案，包括屏幕旋转及校正、设计软键盘进行屏幕输入、利用SQLite存储图片文件。从而证明了当前条件下在嵌入式系统中实现一个比较简单的信息管理系统是完全可行的。最后讨论了该领域存在的一些问题和今后需要进一步研究的课题。
上传时间： 2013-07-10
上传用户：visit8888
目前，许多高校在机房管理上使用了IC 卡，其中少数机房是使用接触式IC卡，众所周知，接触式IC 卡在可靠性、易用性、安全性、高抗干扰性和工作距离方面不及非接触式IC 卡，因此很多接触式IC 卡基本已被非接触式IC 卡取代。 经过调研发现，使用IC 卡的机房管理系统的基本工作方式是每个机房中配置了1个IC 卡读写终端和1 台监控机。IC 卡读卡终端只是一个普通的读卡器，只负责读取卡内信息，并通过串口等通信方式将IC 卡信息传输给监控机，读卡终端本身没有信息存储功能，实际的计费管理完全是通过监控计算机控制，监控计算机向中心服务器端定时或实时传输刷卡信息。由于整个系统要占用一台微机，而且中间的信息传递、计费环节都要由它来完成，不仅浪费资源，而且也增加了安全隐患。在这种工作模式下，会出现一些问题和漏洞： 1) 可靠性不高由于读卡设备与监控计算机之间的信息传输只是暂时保存在监控计算机中，如果监控计算机遭到病毒袭击或者出现硬件故障，将出现无法挽回的后果。而且由于学生信息都保存在监控计算机中，因此存在着人为伪造、篡改和徇私舞弊行为的极大可能。 2) IC卡的特点未完全体现IC卡除了能标识身份外，还有电子钱包功能，能对其进行充值和扣款，但是上述方法基本上IC卡只用做标识身份，实际的每次扣款，都是由监控计算机和中心服务器来完成，基本与读卡设备无关。 3) 不方便学生上机和收费管理学生每次上机刷卡，都要由监控计算机连接中心服务器端，由中心服务器端读出学生信息，进行核对，而且对学生的扣款需要额外的计算机软件来进行计时和计费处理，显得比较繁琐。 鉴于以上问题，为提高机房管理效率，降低工作强度，并及时处理机房发生的故障，采用机房计费管理系统势在必行。如果能在读卡终端设备中完成计费的大部分功能，并且增加存储功能，这样就可以减少监控计算机的负担，甚至读卡终端设备可以直接与中心服务器通信，不仅能增加系统的可靠性和安全性而且还充分利用了IC 卡的功能，还降低了财务统计和计算带来的麻烦。 目前已经应用于机房管理的解决方案主要有3种方式，即:软硬件结合控制方式、帐号方式和门禁方式。鉴于设计要求，并且考虑到安全、可靠、简单等因素，如果在软硬件结合控制方式中，把更多的任务交由读卡终端，比如由读卡终端来存储数据、计费管理，同时如果读卡终端能实现TCP/IP 通信，那么监控计算机的任务就大大降低，甚至可以由读卡终端直接与中心服务器通信。就减少了一些不必要的麻烦和安全风险。本论文的设计就是基于这一点来进行的。 本系统要求数据传输稳定可靠，实时性要好，另外考虑到性价比等因素，综合考虑选择将μC/OS-II 操作系统移植到ARM7 上作为开发平台。在此平台基础上，考虑到TCP/IP协议栈的实现与要采用的硬件的性能以及实现的成本有关。从解决这一技术问题出发，结合本论文研究的应用对象，决定使用嵌入式操作系统，此种方案可以描述为嵌入式TCP/IP协议栈＋嵌入式操作系统＋微控制器。 本文介绍了一种基于ARM7的IC 卡机房管理终端的设计方案。该系统在ARM7的基础上实现了μC/OS-Ⅱ操作系统的移植和TCP/IP协议栈的嵌入，能够正确读写IC 卡信息，增加了SD 卡存储功能，完成计费操作，实现液晶显示功能，能够通过以太网或串口直接与服务器通信。 本文详细介绍了整个机房管理系统终端的硬软件设计，给出了嵌入式操作系统μC/OS-Ⅱ在ARM7 处理器上的详细移植过程，介绍了一种TCP/IP协议栈和基于套接字的编程方法，同时也提供了一种多卡操作的防冲突机制。 同目前大多数机房管理系统相比，该系统有如下特点： 1) 由于使用了嵌入式操作系统μC/OS-Ⅱ，提高了系统的实时性和反应时间，任务管理和调度更加方便有效。 2) 由读卡终端来进行计费操作，降低了服务器端的工作压力，同时降低了安全风险。 3) 增加了数据存储功能，提高了系统的可靠性，有利于数据的查询和故障的恢复。 4) 增加了对无效卡、注销卡和欠费卡的判断与处理，对恶意操作或者有意或者无意的逃费操作采取了积极有效的措施。 5) 以太网通信克服了以往串口通信的传输距离短、传输速率慢等缺点，使得通信更加方便、高效，并且可以进行远距离传输和控制。
上传时间： 2013-07-09
上传用户：浅言微笑
HDMI完全手册，深入浅出，讲得很透彻，很好。
上传时间： 2013-05-29
上传用户：ezgame
盘式永磁同步电动机属于轴向磁场电机，目前，该类电机在国外已经得到了迅速发展，作为一种现代高性能伺服电机和大力矩直接驱动电机己广泛应用于机器人等机电一体化产品中。由于该类电机具有重量轻、体积小、结构紧凑、转子无损耗、转子的转动惯量小、机电时间常数小、转矩/重量比大、低速运行平稳、可以制成多气隙组合式结构进一步提高转矩等特点，其在数控机床、机器人、电动车、电梯、家用电器等场合具有广阔的应用前景，是一种理想的驱动装置。 本课题作为国家863计划项目《新型稀土永磁电机设计及集成技术》2002AA324020中的一部分，该项目的主要工作是进行新型结构钕铁硼永磁电机——盘式无铁心永磁同步电动机的设计与集成技术研究，开发出一种新型钕铁硼永磁电机，解决相应的整机设计和集成技术问题。本文中提出的基于Halbach阵列的盘式无铁心永磁同步电动机是在盘式永磁同步电动机的基础上，将无铁心结构和Halbach型永磁体阵列应用到其中，从而使得电机的质量大为减轻，功率密度提高，振动噪声降低，效率提高。 基于Halbach阵列的盘式无铁心永磁同步电动机其磁路结构和电磁负荷分布与传统电机完全不同，常规电机的某些设计规则不能直接应用到该结构电机的设计当中，本文主要针对这种结构的电机进行了分析与计算。分析了不同结构Halbach阵列下的气隙磁场，以及相关参数的计算，给出了初步的样机设计数据，并对样机的加工工艺进行了探讨，在总结、借鉴相关电机设计方法的基础上，针对盘式无铁心永磁同步电动机自身的特点，编制了一套电磁计算程序，该程序还有待通过大量样机的试验，来总结和完善。 我国稀土资源丰富，然而，由于技术经济上的问题，国产永磁交流伺服电动机至今未能大量应用。与此同时，高性能的永磁交流伺服电动机及系统大量依靠进口，我国每年进口的工程装备当中，仅数控机床因国产电机和系统不能满足要求而每年需要进口的就达22亿美元以上。本项目的完成将改变这类产品主要依靠进口的局面，充分发挥我国稀土资源丰富的优势，其经济效益和社会效益是十分巨大的。
上传时间： 2013-04-24
上传用户：hjkhjk
