计算机四级网络工程师第1套题详细答案 全国计算机等级考试四级网络工程师，简称四级网络工程师。 从2010年的11月起，中国计算机等级考试取消了以往的四级考试。将四级分为三种，其中的一种就是计算机网络工程师。 它主要考察考核网络系统规划与设计的基础知识及中小型网络的系统组建、设备配置调试、网络系统现场维护与管理的基本技能。它要求四级网络工程师合格考生应具有网络系统规划、设计的基本能力，掌握中小型网络系统组建、设备配置调试的基本技术，掌握中小型网络系统现场维护与管理的基本技术。可以从事计算机网络规划、设计、组建与管理的相关工作。 2013年NCRE全国计算机等级考试调整，四级网络工程证书面向已持有三级网络技术证书的考生，考核计算机专业课程。
上传时间： 2017-03-23
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化工水处理相关书籍，包括预处理，一级处理到三级处理，曝气池设计等等，英文版本
上传时间： 2017-05-02
上传用户：fredtanjilin
更好师傅是渡部分info二十年佛科三级片分为进口品类干么污染了每个岗位
上传时间： 2019-11-07
上传用户：我爱你妈妈
小米8手机小米8SE 青春版全系列原厂维修图纸小米8原理图 电路图：小米8屏幕指纹与探索版通用 三级框图.pdf小米8屏幕指纹与探索版通用 三级维修指导.pdf小米8屏幕指纹与探索版通用 位置图 点位图 位号图.pdf小米8屏幕指纹与探索版通用 原理图 电路图.pdf
上传时间： 2021-10-22
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适用于AD软件，常用的电阻，电容，电感，二极管，三级管，IC，LED，按钮，开关，蜂鸣器，晶振等，无论贴片和插件都有，并都带有3D模型，可以更好的检查自己的设计。
标签： Altium designer 元器件 3d封装
上传时间： 2021-10-23
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基于LabVIEWFPGA的三相锁相环设计与实现摘要：针对传统 ＦＰＧＡ 模式开发的锁相环在实时人机交互方面的不足，设 计 了 基 于 ＬａｂＶＩＥＷ ＦＰＧＡ 技术的三相锁相环；方 案 以 ｓｂＲＩＯ－９６３１模块为硬件平台，利用 ＬａｂＶＩＥＷ 编程控制 ＦＰＧＡ 逻辑，在 ＦＰＧＡ 中分三级流水线实现了基于ｄｑ变换的锁相环算法，并通 过 ＦＩＦＯ 实时上传采集信号、锁定相位至 ＰＣ机，最后在 ＰＣ机上实现对锁相环性能分析、ＰＩ参数调控和１ 三相锁相环模型 三相锁相环是基于静止坐标变换和旋转坐标变换 （ｄｑ变 换）的矢量变换实现的 ＶＣＯ 反馈控制。基于ｄｑ变换的改进型 锁相环模型，在ｄｑ变换的基础上提取正序分量进行 ＶＣＯ 反馈 控制，以抑制电压不 平 衡 的 扰 动［４－５］，如 图１所示。三相 信 号 首先经过静止坐标变换到ａβ坐标系μａ、μβ，然后经过 Ｔ／４延时 单元和计算单元计算出三相信号的正序分量变换到ａβ坐 标 系 上的μａｐ 、μβｐ ，此时μａｐ 、μβｐ 是不带电压畸变干扰的分量，对 其进行旋转坐标变换得到μｄ、μｑ。 ｕｑ ＝ｋ＊ｓｉｎ（ωｔ－ω０ｔ） （１） μｑ 的表达如式 （１）所 示，ｋ为与输入电压有关的数，ｗ、 ｗ０ 分别为输入信号角频率和锁定信号角频率。当μｑ 由交流变 量变为直流分量时，ｗ＝ｗ０，锁 相环完 成 鉴 相，经 过 ＶＣＯ 控 制最终锁定相位θ。 ２ 方案设计 系统方案如图２所示，包括三相信号的输入、信号锁相和 实时调控３个部分。其中信号采集和锁相处理在ｓｂＲＩＯ－９６３１ 模块 实现，利 用ｓｂＲＩＯ－９６３１高速运行的特点，对 三 相信 号 进行采集、锁相和输出；ＰＩ参数和θ作为 ＦＰＧＡ 和 ＰＣ机的共 享变量实现数据交互，由ＰＣ机设置ＰＩ参数、
上传时间： 2022-02-18
上传用户：XuVshu
本设备电气性能优良，结构坚固，主要组成部分为收信机和整流器。能装车，且具有人力或兽力搬运的可能。适合于师、团一级或船舶、邮电部门使用。收信的频率范围为1.5~30兆赫，分五个波段。可以接收电报和电话。供电为190，200，220，240伏交流电源。收信机采取一次变频超外差式电路。有二级高频放大器，三级中频放大器，中频频率为600千赫。中频通带有四种，其中3种借助于中频晶体滤波器得到的。机内尚有可控的抑制脉冲干扰的噪声抑制电路开关收信机的频率度盘是用照相法按机刻度的，因此频率刻度的准确度较高。机内有500千赫晶体校准器用以校准度盘刻度。由于在高波段采用了波段展阔电路，故调谐方便。调谐旋钮轴与主调可变电容器及频率度盘由无间隙齿轮传动因此具有良好的再定度与使用可靠性。收信机由传动机构的飞轮惯性作用达到快速调谐效果，而由主调电容器比调谐旋钮轴减速108倍的作用达到慢调的效果。二者是通过同一个旋钮完成的本收信机结构可靠，机箱底部装有减震器。（或装有避震器供装车使用）故能经受颠簸冲击振动长途运输的考验。由于中频回路是密封的，高频电感与波段开关板等经过良好的处理工艺，在电路上则采取温度补偿等措施，使收信设备能在低温、高温及潮湿的条件下使用。机箱及底座均用铝板制成，减轻了收信机的重量。收信机还具有音频，自动增益控制，半双工等输出线。输出端可接二副TA4低阻抗耳机。整流器内用硅二极管作整流，还具有稳流灯丝及稳压电路。本设备使用的电子器件如下：
标签： 短波接收机
上传时间： 2022-03-29
上传用户：shjgzh
倒立摆系统是研究控制理论的一种典型实验装置，具有成本低廉，结构简单物理参数和结构易于调整的优点，是一个具有高阶次、不稳定、多变量、非线性和强耦合特性的不稳定系统。在控制过程中，它能有效地反映诸如稳定性、鲁棒性、随动性以及跟踪等许多控制中的关键问题，是检验各种控制理论的理想模型。迄今人们己经利用经典控制理论、现代控制理论以及各种智能控制理论实现了多种倒立摆系统的控制稳定倒立摆系统的最初研究开始于二十世纪五十年代，麻省理工大学电机工程系设计出单级倒立摆系统这个实验设备。后来在此基础上，人们又进行拓展，产生了各式各样的倒立摆：有悬挂式倒立摆、平行倒立摆、环形倒立摆、平面倒立摆倒立摆的级数有一级、二级、三级、四级乃至多级：倒立摆的运动轨道可以是水平的，也可以是倾斜的：倒立摆系统已成为控制领域中不可或缺的研究设备和验证各种控制策略有效性的实验平台。同时倒立摆研究也具有重要的工程背景：如机器人的站立与行走类似双倒立摆系统：火箭等飞行器的飞行过程中，其姿态的调整类似于倒立摆的平衡。由于倒立摆系统与双足机器人、火箭飞行控制有很大相似性，因此对倒立摆控制机理的研究具有重要的理论和实践意义。而就这两方面而言，从目前的研究情况来看，大部分研究成果又都集中在第面即倒立摆系统的稳定控制的研究早在上个世纪五十年代，国外就开始了倒立摆的研究，我国学者也从80年代初开始倒立摆系统的研究。1966年 Schaefer和 Cannon应用bang-bang控制理论，将一个曲轴稳定于倒置位置，实现了单级倒立摆的稳定控制，在60年代后期，作为一个典型的不稳定严重非线性证例，倒立摆的概念被提出，并将其用于检验控制方法对不稳定、非线性和快速性系统的控制能力，受到世界各国许多科学家的重视，寻找不同的控制方法实现对倒立摆的控制。目前，倒立摆的控制方法可分如下几类
上传时间： 2022-04-05
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[摘要]在天线单元设计中采用了高频、低噪声放大器，以减弱天线热噪声及前面几级单元电路对接收机性能的影响；基于超外差式电路结构、镜频抑制和信道选择原理，选用G P2010芯片实现了射频单元的三级变频方案，并介绍了高稳定度本振荡信号的合成和采样量化器的工作原理，得到了导航电文相关提取所需要的二进制数字中频卫星信号。[被屏蔽广告]关键词：GPS接收机灵敏度超外差锁相环频率合成利用GPS卫星实现导航定位时，用户接收机的主要任务是提取卫星信号中的伪随机噪声码和数据码，以进一步解算得到接收机载体的位置、速度和时间（PVT）等导航信息。因此，GPS接收机是至关重要的用户设备。目前实际应用的GPS接收机电路一般由天线单元、射频单元、通信单元和解算单元等四部分组成，如图1所示。本文在分析GPS卫星信号组成的基础上，给出了射频前端GP2010的原理及应用。1GPS 卫星信号的组成GPS卫星信号采用典型的码分多址（CDMA）调制技术进行合成（如图2所示），其完整信号主要包括载波、伪随机码和数据码等三种分量。信号载波处于L波段，两载波的中心顿率分别记作L1和1.2，卫星信号参考时钟频率f0为10.23MHz，信号载波L1的中心频率为ro的154倍频，即：fL.1=154×f0-1575，42MHz（1）其波长A 1-19.03cm：信号载波12的中心频率为f0的120倍频，即：fL.2-120X f0-1227.60M1z（2）其波长A 2-24.42cm.两载波的频率差为347.82M1z，大约是12的28.3%，这样选择载波频率便于测得或消除导航信号从GPS卫星传播至接收机时由于电离层效应而引起的传播延迟误差，伪随机噪声码（PR N）即测距码主要有精测距码（P码）和粗测距码（C/A码）两种。其中P码的码率为10.23M12、C/A码的码率为1.023MHz。数据码是GPS卫星以二进制形式发送给用户接收机的导航定位数据，又叫导航电文或D码，它主要包括卫星历、卫星钟校正、电离层延迟校正、工作状态信息、C/A码转换到捕获P码的信息和全部卫星的概略星历：总电文由1500位组成，分为5个子帧，每个子帧在6s内发射10个字，每个字30位，共计300位，因此数据码的波特率为50bps.
上传时间： 2022-06-19
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AT89C52是美国ATMEL，公司生产的低电压，高性能CMOS 8位单片机，片内含8k bytes的可反复擦写的Flash只读程序存储器和256 bytes的随机存取数据存储器（RAM），器件采用ATMEL公司的高密度、非易失性存储技术生产，与标准MCS-51指令系统及8052产品引脚兼容，片内置通用8位中央处理器（CPU）和Flash存储单元，功能强大AT89C52单片机适合于许多较为复杂控制应用场合主要性能参数：·与MCS-51产品指令和引脚完全兼容.8k字节可重擦写Flash闪速存储器.1000次擦写周期静态操作：OHz-24MHz·三级加密程序存储器•256х8 hA部RAM•32编程1/0口线.3个16位定时/计数器•8个中断源·程串行UART通道低功耗空闲和掉电模式·PO口：P0口是一组8位漏极开路型双向1/0口，也即地址/数据总线复用口。作为输出口用时，每位能吸收电流的方式驱动8个TTL逻辑门电路，对端口P0写"1"时，可作为高阻抗输入端用.在访问外部数据存储器或程序存储器时，这组口线分时转换地址（低8位）和数据总线复用，在访问期间滋活内部上拉电阻.在Flash编程时，PO口接收指令字节，而在程序校验时，输出指令字节，校验时，要求外接上拉电阻。
标签： at89c52
上传时间： 2022-06-19
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