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Logic Analyzer 的代码
digclk.vhf
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-- Copyright (c) 1995-2005 Xilinx, Inc. All rights reserved.
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digclk.vhd
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-- Copyright (c) 1995-2005 Xilinx, Inc. All rights reserved.
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ps2_lcd1602_1.vhd
library IEEE;
use IEEE.STD_LOGIC_1164.ALL;
use IEEE.STD_LOGIC_ARITH.ALL;
use IEEE.STD_LOGIC_UNSIGNED.ALL;
---- Uncomment the following library declaration if instantiating
---- any Xilinx primitives
sel.vhd
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--实体名：sel
--功 能：实现六个数码显示管扫描显示
--接 口：clk -时钟输入
-- qin1-第一个数码显示管要显示内容输入
-- qin2-第二个数码显示管要显示内容输入
-- qin3-第三个数码显示管要显示内容输入
--
fen60.vhd
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--功 能：60进制计数器
--接 口：clk -时钟输入
-- qout1-个位BCD输出
-- qout2-十位BCD输出
-- carry-进位信号输出
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uart_5kvg_top.vhd
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-- >>>>>>>>>>>>>>>>>>>>>>>>> COPYRIGHT NOTICE
uart_top.vhd
-- --------------------------------------------------------------------
-- >>>>>>>>>>>>>>>>>>>>>>>>> COPYRIGHT NOTICE
加法器描述.txt
-- A Variety of Adder Styles
-- download from: www.fpga.com.cn & www.pld.com.cn
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-- Single-bit adder
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control1.vhd
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
use ieee.std_logic_arith.all;
entity control1 is
port
(
clk :in std_logic;
keydata :in std_logic_vector (3 downt
debounce.vhd
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--按键消抖程序
--原理：为了消除按键时出现抖动的情况，可以引入一个计数器，计数器的值为某一
-- 设定的值，当键按下时，对该数值进行减法计数，如果减到了某个很小的数
-- 值，则输出为有键按下；如果未到那个较小的数值，就说明有抖动 ...