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vhdl 的查询结果
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可编程逻辑 基于FPGA的栈空间管理器的研究和设计
提出了一种将堆栈空间划分为任务栈和中断嵌套栈的设计结构，使堆栈空间最小化。采用VHDL硬件语言，在FPGA设备上模拟实现了具有自动检验功能的栈空间管理器。栈空间管理器由不同功能的逻辑模块组成，主要阐述了状态控制逻辑模块和地址产生逻辑模块的设计方法。 ...
中间件编程  The purpose of this lab is to introduce the concept of FSMs with a datapath, and to stud
&#65279 The purpose of this lab is to introduce the concept of FSMs with a datapath, and to
study the usage of more complex test benches. Also, we enforce a rudimentary design
methodology by assuming that the students are part of a bigger project, and have no
knowledge of VHDL-implementatio ...
VHDL/FPGA/Verilog MAX+PLUSII软件是一个功能强大
MAX+PLUSII软件是一个功能强大，容易使用的软件包，它可以以图
形方式、文字输入方式（AHDL、VHDL和VERILOG）和波形方式输入设计文
件，可以编译并形成各种能够下装到EPROM和各种ALTERA器件的文件，还可
以进行仿真以检验设计的准确性，下面举例说明该软件的使用 ...
VHDL/FPGA/Verilog 利用EDA工具MAX-PlusII的VDHL输入法
利用EDA工具MAX-PlusII的VDHL输入法，输入VHDL程序，实现2位计数器，在七段译码器上以十进制显示：0、1、2、3、0、...。时钟信号使用83管脚。采用自动机状态转换方式设计该计数器；建立相应仿真波形文件，并进行波形仿真；分析设计电路的正确性。 ...
接口技术 quartuscpu
quartus;vhdl控制器运行流程附表控制器运行流程附表
技术资料 基于CPLD的增量式编码器接口电路设计
所设计的基于CPLD的高精度旋转编码器信号处理电路模块,能与多种CPU接口,简单实用。该设计包括四倍频、方向鉴别、双向计数器、与CPU接口等电路。给出了相关VHDL源代码、顶层连接图以及时序仿真结果,能应用于角度测量、位移测量、高度测量等,在控制领域也有广泛应用价值. ...
技术资料 基于FPGA的伪随机序列发生器设计
讨论了应用移位寄存器在Altera的FPGA芯片中实现线性和非线性伪随机序列的方
法， 该算法基于m序列本原多项式来获得线性m序列和非线性m子序列移位寄存器的反馈逻辑
式。文中给出了以Altera的QuartusⅡ为开发平台， 并用VHDL语言实现的m序列的仿真波形. ...
教程资料 利用FPGA驱动LED显示
FPGA驱动LED显示:运用硬件描述语言（如VHDL）设计一个显示译码驱动器，即将要显示的字符译成8段码。由于FPGA有相当多的引脚端资源，如果显示的位数N较少，可以直接使用静态显示方式，即将每一个数码管都分别连接到不同的8个引脚线上，共需要8×N条引脚线控制. ...
教程资料 基于FPGA的运动估计设计
本文采用了技术比较成熟的VHDL语言进行设计，并使用Quartus II软件进行时序仿真。由仿真结果可知，无论是在功能的实现上还是在搜索的准确性、高效性以及FPGA片上资源的利用率上，本设计方案都具有明显的优越性。
可编程逻辑 基于FPGA的运动估计设计
本文采用了技术比较成熟的VHDL语言进行设计，并使用Quartus II软件进行时序仿真。由仿真结果可知，无论是在功能的实现上还是在搜索的准确性、高效性以及FPGA片上资源的利用率上，本设计方案都具有明显的优越性。