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其他  乘法器

乘法器，用VHDL语言编码，可能对你用处不是很大，但做为参考还是很大用处的

https://www.eeworm.com/dl/534/200609.html

下载: 37

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乘法器

其他  计数器

计数器，用VHDL语言编码，可能对你用处不是很大，但做为参考还是很大用处的

https://www.eeworm.com/dl/534/200611.html

下载: 36

查看: 1026

计数器

其他  分频器

分频器，用VHDL语言编码，可能对你用处不是很大，但做为参考还是很大用处的

https://www.eeworm.com/dl/534/200612.html

下载: 121

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分频器

VHDL/FPGA/Verilog 本程序以Modelsim为开发平台

本程序以Modelsim为开发平台，采用VHDL为开发语言，实现了简单的全加器．适合初学Modelsim的同行

https://www.eeworm.com/dl/663/217290.html

下载: 196

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Modelsim 程序开发平台

VHDL/FPGA/Verilog 利用触发器实现的

利用触发器实现的，8位半加器的VHDL语言实现，适用于altera系列FPGA

https://www.eeworm.com/dl/663/251829.html

下载: 84

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触发器

VHDL/FPGA/Verilog 相位差测试

相位差测试，频率测试、频率计数器、闸门控制器、显示译码控制的vhdl程序

https://www.eeworm.com/dl/663/293948.html

下载: 155

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相位差测试

VHDL/FPGA/Verilog 38译码器的设计

38译码器的设计，使用vhdl设计译码器，可以下载到开发板上看结果

https://www.eeworm.com/dl/663/314829.html

下载: 194

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译码器

VHDL/FPGA/Verilog 次源码实现一个扩频接收机系统

次源码实现一个扩频接收机系统，用VHDL语言编写，并且有完整得测试程序

https://www.eeworm.com/dl/663/342368.html

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源码扩频接收机

VHDL/FPGA/Verilog 用于FPGA的变长编码算法的HDL编码

用于FPGA的变长编码算法的HDL编码，包括VHDL及Verilog代码。可用于JPEG及MPEG压缩算法。

https://www.eeworm.com/dl/663/344134.html

下载: 168

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FPGA HDL 编码算法编码

VHDL/FPGA/Verilog 对与单片机常用的功能看门狗

对与单片机常用的功能看门狗，本程序用vhdl硬件语言实现次功能。

https://www.eeworm.com/dl/663/354535.html

下载: 71

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单片机常用看门狗

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