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文章/文档  线性相位FIR滤波器（17阶）的VHDL语言设计功能很强大

线性相位FIR滤波器（17阶）的VHDL语言设计功能很强大，很好用

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VHDL FIR 线性相位

交通/航空行业  该程序实现的功能是：基于VHDL语言的出租车计价器。

该程序实现的功能是：基于VHDL语言的出租车计价器。

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VHDL 程序出租车计价器语言

VHDL/FPGA/Verilog 能更快的了解VHDL 让人更好的入门里面有大量的实例分析

能更快的了解VHDL 让人更好的入门里面有大量的实例分析

https://www.eeworm.com/dl/663/339867.html

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VHDL 分

VHDL/FPGA/Verilog 用VHDL语言将二进制数据转换成十进制数据

用VHDL语言将二进制数据转换成十进制数据，并将十进制的每一个位分离出来单独存放。使用状态机实现，程序简单，仿真效果很理想，占用可编程器件的资源较少。

https://www.eeworm.com/dl/663/344517.html

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VHDL 数据语言二进制

VHDL/FPGA/Verilog 利用FPGA实现频率测试,基于VHDL实现,具有良好的测试性能可直接使用

利用FPGA实现频率测试,基于VHDL实现,具有良好的测试性能可直接使用

https://www.eeworm.com/dl/663/352308.html

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FPGA VHDL 测试频率

VHDL/FPGA/Verilog 这是一个用VHDL语言描述的I2C自动配置模块

这是一个用VHDL语言描述的I2C自动配置模块，使用了来自opencores.org的I2C核，已在altera的cyclone芯片上调试通过

https://www.eeworm.com/dl/663/352458.html

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VHDL I2C 语言自动

VHDL/FPGA/Verilog 这是一个用VHDL语言实现的非常实用的表决器

这是一个用VHDL语言实现的非常实用的表决器

https://www.eeworm.com/dl/663/364681.html

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VHDL 语言表决器

VHDL/FPGA/Verilog 8.20 电子时钟VHDL程序与仿真为初学者提供很好的范例

8.20 电子时钟VHDL程序与仿真为初学者提供很好的范例

https://www.eeworm.com/dl/663/377487.html

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8.20 VHDL 电子时钟仿真

VHDL/FPGA/Verilog fpga嵌入式设计扩频接收机设计有matlab 和vhdl 对比情况

fpga嵌入式设计扩频接收机设计有matlab 和vhdl 对比情况

https://www.eeworm.com/dl/663/377625.html

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matlab fpga vhdl 嵌入式设计

VHDL/FPGA/Verilog vhdl语言程序的a244器件的程序希望对大家的学习有所帮助

vhdl语言程序的a244器件的程序希望对大家的学习有所帮助

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vhdl a244 语言程序器件

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