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https://www.eeworm.com/dl/663/379463.html VHDL/FPGA/Verilog

VHDL实现的示波器-完整的文档和源代码

VHDL实现的示波器-完整的文档和源代码，可在fpga实现

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#VHDL #示波器 #文档 #源代码

https://www.eeworm.com/dl/663/381043.html VHDL/FPGA/Verilog

FFT的VHDL实现程序希望对大家有用

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#VHDL #FFT #程序 #家

https://www.eeworm.com/dl/663/382599.html VHDL/FPGA/Verilog

dallas one wire的VHDL实现方式,比较常用的.

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#dallas #VHDL #wire #one

https://www.eeworm.com/dl/663/383147.html VHDL/FPGA/Verilog

用VHDL编写的一个LED显示程序

用VHDL编写的一个LED显示程序，展示一种全新的LED设计

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#VHDL #LED #编写 #显示程序

https://www.eeworm.com/dl/663/383822.html VHDL/FPGA/Verilog

这是一个130个vhdl代码的实例

这是一个130个vhdl代码的实例，其中说明都在压缩包里面的

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#vhdl #130 #代码

https://www.eeworm.com/dl/663/384434.html VHDL/FPGA/Verilog

VHDL语言编写的全功能串口模块（包含DTR

VHDL语言编写的全功能串口模块（包含DTR，RTS等管脚），在CPLD器件上测试通过

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#VHDL #DTR #语言 #编写

https://www.eeworm.com/dl/663/388202.html VHDL/FPGA/Verilog

应用MaxplusII平台的数字时钟的VHDL源程序

应用MaxplusII平台的数字时钟的VHDL源程序，可以解压后直接运行，已经过测试，希望对大家有所帮助。

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#MaxplusII #VHDL #数字时钟 #源程序

https://www.eeworm.com/dl/663/390049.html VHDL/FPGA/Verilog

24位AD PCM1770的VHDL控制模块

24位AD PCM1770的VHDL控制模块，经实践检验可用

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#1770 #VHDL #PCM #24位

https://www.eeworm.com/dl/663/390067.html VHDL/FPGA/Verilog

同步写USB_SLAVE_FIFO的VHDL源代码

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#USB_SLAVE_FIFO #VHDL #源代码

https://www.eeworm.com/dl/663/391265.html VHDL/FPGA/Verilog

关于电压表的一个VHDL程序

关于电压表的一个VHDL程序，能够成功实现，可共初学者学习

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#VHDL #电压表 #程序