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verilog hdl 是什么？ 的查询结果
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技术资料 基于DSP和FPGA的高性能永磁同步电动机位置伺服系统.pdf
永磁同步电动机（pmsm）具有较高的运行效率、较高的转矩密度、转动惯量小、转矩脉动小、可高速运行等特点，因此在诸如高性能机床进给控制、位置控制…、机器人等领域pmsm得到了广泛的应用[1]。 一个高性能伺服系统需要有快速响应性以及良好的控制性能。随着控制技术的发展，优良的控制算法逐渐地被应用到伺服系统中来提高系 ...
技术资料 基于FPGA的逻辑分析技术
本文了描述了一种二次生成的嵌入式系统级调试工具SignalTap的工作原理和其特点,它可以在特定的FPGA器件以系统运行的速度观察到内部所有的节点,但是它只能用在特定公司生产的器件上,通用性不高.本论文参考并且模仿其部分原理,结合FPGA器件设计方便、灵活、校验快和设计可重复改变的特点,形成一个移植性很高的具有逻辑分析功 ...
技术资料 线性调频脉冲压缩雷达目标视频信号
雷达信号模拟技术和现代雷达技术的发展息息相关。雷达信号模拟设备可以仿真出各种符合实验要求的目标信号来，直接注入雷达来对雷达进行试验，极大的方便了雷达的设计与调试。 本课题主要研究利用FPGA实现线性调频脉冲压缩雷达目标信号的模拟。全文的内容如下： 首先详细阐述了线性调频(LFM)脉冲压缩雷达脉冲压缩原理，分析 ...
VIP专区 VIP专区-嵌入式/单片机编程源码精选合集系列（27）
VIP专区-嵌入式/单片机编程源码精选合集系列（27）资源包含以下内容：1. Verilog源码15.2. Verilog源码11.3. verilog基础知识.4. Verilog硬件描述语言教程.5. 手机电池电路智能化研究.6. wince平台evc实现的全屏.7. 数控仿真与网络控制系统(雏形).8. Interface 4x4 matrix keypad with 8051 IO.9. mifare射频卡读卡源程序.1 ...
技术书籍 高级ASIC芯片综合
·【内容简介】本书第2版描述了使用Synopsys工具进行ASIC芯片综合、物理综合、形式验证和静态时序分析的最新概念和技术，同时针对VDSM(超深亚微米)工艺的完整ASIC设计流程的设计方法进行了深入的探讨。.本书的重点是使用Synopsys32具解决各种VDSM问题的实际应用。读者将详细了解有效处理复杂亚微米ASIC的设计方法，其重点是 ...
技术资料 高级ASIC芯片综合
·【内容简介】本书第2版描述了使用Synopsys工具进行ASIC芯片综合、物理综合、形式验证和静态时序分析的最新概念和技术，同时针对VDSM(超深亚微米)工艺的完整ASIC设计流程的设计方法进行了深入的探讨。.本书的重点是使用Synopsys32具解决各种VDSM问题的实际应用。读者将详细了解有效处理复杂亚微米ASIC的设计方法，其重点是 ...
技术资料 基于DSP_Builder的星座映射与解映射器设计
· 摘要：  提出了一种基于中国地面数字电视广播传输标准的星座映射与解映射器的设计方法.使用DSP Builder的各种模块搭建系统,并利用Signal Compiler生成HDL工程.在完成对所生成工程的优化后,进行相关软硬件仿真验证.实现了32QAM、16QAM星座映射器与解映射器的设计、仿真,并在利用DSP Builder进行DSP系统开发方面 ...
开发工具 如何仿真IP核(建立modelsim仿真库完整解析)
IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库的模块 ...
仿真技术 如何仿真IP核(建立modelsim仿真库完整解析)
IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库的模块 ...