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verilog hdl 是什么？ 的查询结果
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技术资料 嵌入式Linux应用程序开发资料
嵌入式Linux应用程序开发资料随着摩托罗拉手机A760、IBM智能型手表WatchPad、夏普PDA Zaurus等一款款高性能“智能数码产品”的出现，以及Motolola、三星、MontaVista、飞利浦、Nokia、IBM、SUN等众多国际顶级巨头的加入，嵌入式Linux 的队伍越来越庞大了。在通信、信息、数字家庭、工业控制等领域，随处都能见到嵌入式Linux ...
串口编程 2005-7-13 10:03 前几天要做一个短信收发的小软件
2005-7-13 10:03
前几天要做一个短信收发的小软件，于是按照习惯Box寻找例程和控件，可惜没有找到！
于是,大幅翁、Google!!!终于找到了好几个，不是要收费就是不能用！气愤！！
这又不是什么高新尖端科技，俺们不是做不出来,俺们只是秉承RAD的精神而已！
于是这个短消息控件诞生了！虽然还很简陋，起码胳膊腿都有了，剩下就 ...
VC书籍 学习方法: 1、明确问题 列举尽可能多的问题
学习方法:
1、明确问题
列举尽可能多的问题，越具体越好。
“这是什么意思？”；“为什么这样？”；“若这样变一下，则会怎样？”……
及时收集问题，重点解决。
2、勤于实践
分析问题；找到解决方案；纸面上编程实现方案；纸面上测试程序、并确定测试数据；
上机测试、修改、再测试；总结、提高。
3、力争主动
加强预习： ...
学术论文 PCI从设备控制器的FPGA设计与实现
随着星载电子系统复杂度、小型化需求的提高，SoC已经成为应对未来星载电子系统设计需求的解决途径。为了简化设计流程并且提高部件的可重用性，在目前的SoC设计中引入了称之为平台的体系结构模板，用它来描述采用已有的标准核来开发SoC的方法。在星载电子系统中常用部件的分类设计，最终建立一个包括多种功能部件，互连部件 ...
技术资料 PCI从设备控制器的FPGA设计与实现.rar
随着星载电子系统复杂度、小型化需求的提高，SoC已经成为应对未来星载电子系统设计需求的解决途径。为了简化设计流程并且提高部件的可重用性，在目前的SoC设计中引入了称之为平台的体系结构模板，用它来描述采用已有的标准核来开发SoC的方法。在星载电子系统中常用部件的分类设计，最终建立一个包括多种功能部件，互连部件 ...
技术资料 PCI从设备控制器的FPGA设计与实现
随着星载电子系统复杂度、小型化需求的提高，SoC已经成为应对未来星载电子系统设计需求的解决途径。为了简化设计流程并且提高部件的可重用性，在目前的SoC设计中引入了称之为平台的体系结构模板，用它来描述采用已有的标准核来开发SoC的方法。在星载电子系统中常用部件的分类设计，最终建立一个包括多种功能部件，互连部件 ...
技术资料 VerilogHDL那些事儿——整合篇
笔者详细的谈论许多在整合里会出现的微妙思路，如：如何把计数器/定时器整合在某个步骤里，从何提升模块解读性和扩展性。此外，在整合篇还有一个重要的讨论，那就是 for，while 和 do ... while 等循环。这些都是一些顺序语言的佼佼者，可是在 Verilog HDL 语言里它们就黯然失色。整合篇所讨论的内容不单是循环而已，整合篇 ...
教程资料 采用FPGA模拟高动态GPS信号源中的C／A码产生器
本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用，通过硬件描述语言VERILOG在ISE中实现电路生成，采用MODELSIM、SYNPLIFY工具分别进行仿真和综合。 ...
系统设计方案 本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用
本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用，通过硬件描述语言VERILOG在ISE中实现电路生成，采用MODELSIM、SYNPLIFY工具分别进行仿真和综合。 ...