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https://www.eeworm.com/dl/856791.html 技术资料

基于CPLD的SGPIO总线实现及应用

分析了SGPIO总线的数据传输机制，用CPLD模拟SGPIO总线协议来实现并行数据的串行传输，并将其与串并数据转换集成芯片进行对比，说明了前者的应用优势，并且指出了其应用场合。采用Lattice Diamond IDE进行了Verilog HDL代码编写和综合，并用ModelSire进行时序仿真，最终下载到CPLD器件进行测试。结果证 ...

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#CPLD #SGPIO总线

https://www.eeworm.com/dl/663/192042.html VHDL/FPGA/Verilog

文件包含一个usb 专用集成电路设计项目

文件包含一个usb 专用集成电路设计项目，用的verilog 原码

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#usb #专用集成电路 #项目

https://www.eeworm.com/dl/663/237501.html VHDL/FPGA/Verilog

fpga模拟以太网物理层的源代码

fpga模拟以太网物理层的源代码，用verilog硬件描述语言开发。

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#fpga #模拟 #以太网 #物理层

https://www.eeworm.com/dl/663/287236.html VHDL/FPGA/Verilog

英文书籍

英文书籍，好像是verilog发明者所写，第5版。很好的书

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#英文 #书籍

https://www.eeworm.com/dl/663/362734.html VHDL/FPGA/Verilog

用VHDL语言编写的LDPC码硬件实现语言

用VHDL语言编写的LDPC码硬件实现语言，相对于verilog的，比较简单

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#VHDL #LDPC #语言 #编写

https://www.eeworm.com/dl/663/366427.html VHDL/FPGA/Verilog

FPGA开发

FPGA开发，Verilog的经典教程，在嵌入式培训中的电子书籍。

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#FPGA

https://www.eeworm.com/dl/647/397391.html 嵌入式/单片机编程

FIFO级联

FIFO级联，利用verilog语言实现Xilinx FIFO18单元的多个级联，增大FIFO深度。

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#FIFO #级联

https://www.eeworm.com/dl/624/444540.html 串口编程

带有自适应功能的UART

带有自适应功能的UART，是用VERILOG编写的源码，包括测试文件，与大家分享

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#UART

https://www.eeworm.com/dl/624/466179.html 串口编程

很好用的串口通讯程序

很好用的串口通讯程序，已经通过验证，用Verilog语言编写的放心使用了！

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#串口通讯 #程序

https://www.eeworm.com/dl/663/470562.html VHDL/FPGA/Verilog

8051内核的设计

8051内核的设计，用Verilog硬件描述语言实现，在modelsim环境下进行仿真。

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#8051 #内核