搜索：verilog hdl 是什么？

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cpld与8051的总线接口vhdl设计源码.rar

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VHDL程序实例集 167页 3.1M.PDF

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https://www.eeworm.com/dl/960635.html 技术资料

VHDL中Loop动态条件的可综合转化.pdf

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https://www.eeworm.com/dl/962641.html 技术资料

VHDL数字系统设计与高层次综合.dat

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https://www.eeworm.com/dl/963819.html 技术资料

FPGA_VHDL快速工程实践入门与提高.rar

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https://www.eeworm.com/dl/663/238051.html VHDL/FPGA/Verilog

摘 要：以上海地区的出租车计费器为例

摘 要：以上海地区的出租车计费器为例，利用Verilog HDL语言设计了出租车计费器，使其具有时间 显示、计费以及模拟出租车启动、停止、复位等功能，并设置了动态扫描电路显示车费和对应时间，显示 了硬件描述语言Verilog—HDL设计数字逻辑电路的优越性。源程序经MAX+PLUS Ⅱ软件调试、优 化，下载到EPF1 ...
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https://www.eeworm.com/dl/663/147668.html VHDL/FPGA/Verilog

CRC校验码

CRC校验码，用于对数据流进行crc校验。 主要有CRC_16,CRC_8,CRC_32校验。 所用语言为Verilog HDL.
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https://www.eeworm.com/dl/663/441251.html VHDL/FPGA/Verilog

这是CAN总线控制器的IP核

这是CAN总线控制器的IP核，源码是由Verilog HDL编写的。其硬件结构与SJA1000类似，满足CAN2.0B协议。
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https://www.eeworm.com/dl/882019.html 技术资料

VHDL语言100例详解 511页 7.4M.pdf

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VHDL在高速图像采集系统中的应用设计.pdf

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