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VHDL/FPGA/Verilog 一个简单的Modular Design设计,源代码

一个简单的Modular Design设计,源代码，分别用Verilog和VHDL两种语言描述，本设计顶层模块由3个子模块组成.
https://www.eeworm.com/dl/663/314062.html
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VHDL/FPGA/Verilog ALTERA原厂提供的例程

ALTERA原厂提供的例程，网上很难找到的，在MAX2系列芯片上实现过，VHDL和VERILOG两种语言编写 IIC读写程序
https://www.eeworm.com/dl/663/491117.html
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技术资料 数字电路EDA 入门：VHDL 程序实例集.PDF

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->数字电路EDA 入门：VHDL 程序实例集.PDF
https://www.eeworm.com/dl/880719.html
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技术资料 三本华为FPGASOPC培训教材.rar

三本华为培训教材，分别为：FPGA设计高级技巧Xilinx篇；Verilog基本电路设计指导书；大规模逻辑设计指导书
https://www.eeworm.com/dl/897941.html
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技术资料 VerilogHDL实践与应用系统设计.rar

书名：Verilog-HDL实践与应用系统设计，主要内容包括硬件描述语言、组合和时序逻辑电路、触发器、应用系统设计实例等
https://www.eeworm.com/dl/898002.html
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技术资料 cpld与8051的总线接口vhdl设计源码.rar

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->cpld与8051的总线接口vhdl设计源码.rar
https://www.eeworm.com/dl/950082.html
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技术资料 VHDL程序实例集 167页 3.1M.PDF

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL程序实例集 167页 3.1M.PDF
https://www.eeworm.com/dl/959618.html
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技术资料 VHDL中Loop动态条件的可综合转化.pdf

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL中Loop动态条件的可综合转化.pdf
https://www.eeworm.com/dl/960635.html
下载: 10
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技术资料 VHDL数字系统设计与高层次综合.dat

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL数字系统设计与高层次综合.dat
https://www.eeworm.com/dl/962641.html
下载: 9
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技术资料 FPGA_VHDL快速工程实践入门与提高.rar

资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->FPGA_VHDL快速工程实践入门与提高.rar
https://www.eeworm.com/dl/963819.html
下载: 3
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