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技术资料  利用Verilog设计的16位CPU的设计案例

利用Verilog设计的16位CPU的设计案例，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈

https://www.eeworm.com/dl/834053.html

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verilog cpu

技术资料  ALTERA关于CCD的一些verilog实验程序

ALTERA关于CCD的一些verilog实验程序，适合感兴趣的学习者学习，可以提高自己的能力，大家可以多交流哈

https://www.eeworm.com/dl/834088.html

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altera ccd verilog

技术资料  硬件描述语言Verilog (第四版)

比较好的Verilog教程。适合初学者。比较详细，比较容易理解

https://www.eeworm.com/dl/834999.html

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verilog

技术资料  Verilog HDL那些事儿 -- 建模篇 V5.pdf

让你从另一个角度看待verilog建模，感受FPGA开发的乐趣

https://www.eeworm.com/dl/835031.html

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Verilog HDL FPGA

技术资料  Verilog数字系统设计-RTLl综合、测试平台与验证

   国外经典verliog教程，深入电路内部结合电路学习verliog，通过数字电路本质来理解和学习verliog语言，才是符合数字逻辑学习规律。

https://www.eeworm.com/dl/839453.html

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verilog 数字系统设计

技术资料  verilog的 DS18B20例程

基于verilog的DS18B20的代码，用于读取DS18B20的数据并在FPGA开发板上显示

https://www.eeworm.com/dl/840439.html

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ds18b20

技术资料  硬件描述语言Verilog，第四版

硬件描述语言Verilog，初学者使用

https://www.eeworm.com/dl/840453.html

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verilog

技术资料  基于matlab FPGA verilog的FIR滤波器设计

本例程实现8阶滤波器，9个系数，由于系数的对称性，h(0)=h(8)，h1(1)=h(7)，h(2)=h(6)，h(3)=h(5)，h(4)为中间单独一个系数。实现框图：推导出当系数N为偶数时,例如N=4：y(n)=h(0)*{x(0)+x(n-3)}+h(1)*{x(n-1)+x(n-2)}当系数N为奇数时，例如N=5：y(n)=h(0)*{x(0)+x(n-1)}+h(1)*{x(n-1)+x(n-3)}+h(2)*x(n-2)1、用matlab生成 ...

https://www.eeworm.com/dl/846347.html

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matlab fpga verilog FIR 滤波器

技术资料  Verilog HDL应用程序设计实例精讲

此书为verilog经典教材，书中列举大量verilog代码实例来讲授理论，非常实用的一本书。

https://www.eeworm.com/dl/848140.html

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verilog hdl 程序设计

技术资料  北航-夏宇闻-Verilog-HDL语法详细讲解

该文档为verilog学习方法讲解文档，是一份很不错的参考文档，可以下载来看看，，，，，，，，，，，，，，，，，，，，，

https://www.eeworm.com/dl/849963.html

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