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VHDL/FPGA/Verilog This leon3 design is tailored to the Altera NiosII Startix2 Development board, with 16-bit DDR SDR
This leon3 design is tailored to the Altera NiosII Startix2
Development board, with 16-bit DDR SDRAM and 2 Mbyte of SSRAM.
As of this time, the DDR interface only works up to 120 MHz.
At 130, DDR data can be read but not written.
NOTE: the test bench cannot be simulated with DDR enabled
because ...
单片机开发 MSP430F133开发板代码包 独立按键(C) 5_1_6_1.c 扫描按键 key.s43 扫描按键(C) key.c ADC 5_1_8.s43 5_1_9_1.s43 I
MSP430F133开发板代码包
独立按键(C) 5_1_6_1.c
扫描按键 key.s43
扫描按键(C) key.c
ADC 5_1_8.s43
5_1_9_1.s43
IIC器件 test24C256.S43
键盘与显示 keyDIP.S43
键盘与显示以及低功耗 keydLPM.S43
电子琴 keyQing.S43
温度报警系统 keyDLAS_ALARM.S43
固体录音机 4004_KEY.s43
时间控制器 time_cont.c
交通灯 ...
其他行业 * acousticfeatures.m: Matlab script to generate training and testing files from event timeseries. *
* acousticfeatures.m: Matlab script to generate training and testing files from event timeseries.
* afm_mlpatterngen.m: Matlab script to extract feature information from acoustic event timeseries.
* extractevents.m: Matlab script to extract event timeseries using the complete run timeseries and the ...
其他行业 本代码提供读取Segy格式地震数据的SegyReader类（C++） 在segy.h文件中有segy卷头/道头的每一个字段的中文详细说明,方便大家查询使用. 另外, 使用QT3.x制作的G
本代码提供读取Segy格式地震数据的SegyReader类（C++）
在segy.h文件中有segy卷头/道头的每一个字段的中文详细说明,方便大家查询使用.
另外, 使用QT3.x制作的GUI界面程序, 可以选择一个segy文件, 使用SegyReader类读取并显示相关信息在界面上.
===sr.exe的执行需要QT3.3.4的dll文件(因文件较大故未加入，需要者安装QT3.3 ...
其他嵌入式/单片机内容 这是LPC2200系列芯片内部Flash和外部Flash同时装载程序的分散加载文件使用示例。 ext_in.scf为分散加载文件
这是LPC2200系列芯片内部Flash和外部Flash同时装载程序的分散加载文件使用示例。
ext_in.scf为分散加载文件，具体请读者自行分析，我们不对此示例提供技术支持。
在示例程序生成目标的test_ext_in.i32文件夹下有2个文件
/ ROM_EXEC －－－ 写入内部FLASH
/ ROM_EXEC1 －－－ 写入外部FLASH
(在选择文件的时候，请选 ...
VHDL/FPGA/Verilog Top module name : SHIFTER (File name : SHIFTER.v) 2. Input pins: SHIFT [3:0], IN [15:0], SIGN, RIGH
Top module name : SHIFTER (File name : SHIFTER.v)
2. Input pins: SHIFT [3:0], IN [15:0], SIGN, RIGHT.
3. Output pins: OUT [15:0].
4. Input signals generated from test pattern are latched in one cycle and are
synchronized at clock rising edge.
5. The SHIFT signal describes the shift number. The shift ...
VHDL/FPGA/Verilog Top module name : SHIFTER (File name : SHIFTER.v) 2. Input pins: SHIFT [3:0], IN [15:0], SIGN, RIGH
Top module name : SHIFTER (File name : SHIFTER.v)
2. Input pins: SHIFT [3:0], IN [15:0], SIGN, RIGHT.
3. Output pins: OUT [15:0].
4. Input signals generated from test pattern are latched in one cycle and are
synchronized at clock rising edge.
5. The SHIFT signal describes the shift number. The shift ...
Java编程 Servlets and JavaServer Pages is the first complete guide to building dynamic Java-based Web applica
Servlets and JavaServer Pages is the first complete guide to building dynamic Java-based Web applications using the new JavaServer Pages 2.0 and Servlets 2.4. Servlets and JavaServer Pages (JSP) provide a robust solution to developing large, complex Web applications, including multiserver projects. ...
技术资料 文本情感分析python实现代码
emotion文件夹的东西是搜集到的词典，txt.txt文档是我用以分析的文本，具体分析出来的文本时在text.xlsx中保存。test.py是用Python实现的情感类别统计代码，在这里我只考虑了否定词的作用，以及负面情绪的频次，如有需要可以进行改进。文本数据是微博评论，去观察情感倾向，真正实现的时候用了pandas包、jieba包，思路为if- ...
单片机编程 keil uvision2使用教程
Keil uVision2是目前使用广泛的单片机开发软件，它集成了源程序编辑和程序调试于一体，支持汇编、C、PL/M语言。  这里我们仅仅介绍 Keil uVision2 的简单使用，更详细的使用方法见本光盘\单片机软件\Keil c51\Keil书籍与资料目录中的内容。     keil C51 v6.12 的安装：  先运行光盘中 单片 ...