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找到约 8,501 项符合 system verilog 的查询结果

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技术资料 (网盘)FPGA 资料视频

黑金—Verilog HDL教程    -黑金—NIOSII视频教程    -黑金—FPGA-驱动篇    -夏宇闻—VerilogHDL视频教程.rar    144M特权—深入浅出玩转FPGA视频(35讲).rar    1.7G
https://www.eeworm.com/dl/835473.html
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技术资料 Altera CAM

Altera没有CAM的IP core。此文件是一个自己设计的65x256的CAM VHDL和Verilog源文件,用于存放MAC地址和IP地址的查找表。修改内部参数可以实现不同宽度和深度的查找表。已基于EP2AGX125EF35I3编译通过,需要消耗18个M9K RAM。
https://www.eeworm.com/dl/995137.html
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技术资料 25分频

在数字电路设计中,25分频的Verilog代码适用于需要精确时钟控制的应用场景。无论是在嵌入式系统还是FPGA项目开发中,这一技术方案都能有效实现频率转换,确保系统运行稳定可靠。通过简单的配置,即可快速集成到现有项目中,提升整体性能。 ...
https://www.eeworm.com/dl/995286.html
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VIP专区 VIP专区-嵌入式/单片机编程源码精选合集系列(27)

VIP专区-嵌入式/单片机编程源码精选合集系列(27)资源包含以下内容:1. Verilog源码15.2. Verilog源码11.3. verilog基础知识.4. Verilog硬件描述语言教程.5. 手机电池电路智能化研究.6. wince平台evc实现的全屏.7. 数控仿真与网络控制系统(雏形).8. Interface 4x4 matrix keypad with 8051 IO.9. mifare射频卡读卡源程序.1 ...
https://www.eeworm.com/vipdownload/125.html
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单片机编程 基于8098单片机的SPWM变频调速系统

  数字控制的交流调速系统所选用的微处理器、功率器件及产生PWM波的方法是影响交流调速系统性能好坏的直接因素。在介绍了正弦脉宽调制(SPWM)技术的基础上,设计了一种以8098单片机作为控制器,以智能功率模块IPM为开关器件的变频调速系统。通过软件编程,产生正弦脉冲宽度调制波形来控制绝缘栅双极晶体管的导通和关断, ...
https://www.eeworm.com/dl/502/29059.html
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工控技术 西门子建筑电器-电气安装技术部发行的各类产品样本

西门子建筑电器-电气安装技术部发行的各类产品样本:小型断路器、剩余电流保护断路器和模数化产品(中/ 英文)Miniature Circuit-Breakers, Residual Current Operated Circuit-Breakers and Modular Devices (Chinese/English)低压熔断器系统(中/ 英文)Fuse System (Chinese/English)雷击,过电压-不再是问题(中文)Thunders ...
https://www.eeworm.com/dl/569/41394.html
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技术资料 半导体制冷温度控制系统的设计研究

在半导体制冷技术的工作性能及其优缺点研究的基础上,设计了以单片机为核心控制元件,以TEC1-12706为执行元件的半导体制冷温度控制系统。采用高精度分段式PID控制算法配合PWM输出控制的方法实现温度控制;选择数字传感器DS18B20为温度检测元件,还包含1602液晶显示模块、按键调整输入模块和H桥驱动模块等。实际测试表明,该系统 ...
https://www.eeworm.com/dl/831628.html
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技术资料 基于单片机的跌倒检测报警系统设计

当代社会,老年人群健康安全监护的需求日益增加,老年人跌倒检测的研究成为社会关注热点。故文章设计了一种基于单片机的跌倒检测报警系统,选用STC89C52单片机作为控制芯片、ADXL345传感器作为检测模块以及GSM发送装置作为通信模块。首先,利用检测模块采集老人日常活动中的运动数据,经模数转换后将其发送给单片机,以判断老年人 ...
https://www.eeworm.com/dl/895401.html
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技术资料 基于单片机的一种便携式输液监控系统

本系统使用STC89C51单片机为主控芯片,以非接触电容式液位检测传感器为检测元件,以LC12S型串口无线收发模块为信号传输装置,用以实现将住院楼患者的输液信息进行多点采集、统一管理,当输液将结束时,报警信号通过无线传输到护士台,对于条件一般的医院中控系统会根据检测结果实现声光报警,并显示具体的报警位置;对于条件较好的 ...
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开发工具 如何仿真IP核(建立modelsim仿真库完整解析)

  IP核生成文件:(Xilinx/Altera 同)   IP核生成器生成 ip 后有两个文件对我们比较有用,假设生成了一个 asyn_fifo 的核,则asyn_fifo.veo 给出了例化该核方式(或者在 Edit-》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式)。asyn_fifo.v 是该核的行为模型,主要调用了 xilinx 行为模型库的模块 ...
https://www.eeworm.com/dl/550/37748.html
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