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system verilog 的查询结果
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加密解密 SMS4是国内第一个公布的商用分组密码算法
SMS4是国内第一个公布的商用分组密码算法,其重要应用性可想而知。源码中包括C代码和verilog源码。
VHDL/FPGA/Verilog 这是CAN总线控制器的IP核
这是CAN总线控制器的IP核,源码是由Verilog HDL编写的。其硬件结构与SJA1000类似,满足CAN2.0B协议。
技术资料 VHDL语言100例详解 511页 7.4M.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL语言100例详解 511页 7.4M.pdf
技术资料 高效状态机设计.rar
高效的状态机设计,很不错的书,有3个例子和一个pdf说明文档,学习verilog的朋友可以多看看
技术资料 VHDL在高速图像采集系统中的应用设计.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDL在高速图像采集系统中的应用设计.pdf
技术资料 用VHDL 设计的步进电机脉冲分配器.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->用VHDL 设计的步进电机脉冲分配器.pdf
技术资料 OFDM基带发信机设计
帮助通信工程师快速掌握OFDM基带发信机的实现逻辑,通过Verilog代码深入理解调制与信号处理流程,提升系统设计能力。
技术资料 VGA Timing Generator
基于Verilog实现的VGA时序控制模块,采用同步设计方法确保信号稳定性。支持标准VGA分辨率,适用于FPGA开发与显示接口调试。
教程资料 xilinx Zynq-7000 EPP产品简介
The Xilinx Zynq-7000 Extensible Processing Platform (EPP) redefines the possibilities for embedded systems, giving system and software architects and developers a flexible platform to launch their new solutions and traditional ASIC and ASSP users an alternative that aligns with today’s progr ...