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技术资料  vivado下加法器与减法器的实现

在VIVADO下用verilog语言实现加法器与减法器，溢出会提示，负值会提示

https://www.eeworm.com/dl/864238.html

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加法器减法器 VIVADO XILINX

技术资料  Quartus II V11.0 破解版

该软件为FPGA的开发方针软件，在windows环境下运行。使用Verilog HDL语言编写脚本，很好用

https://www.eeworm.com/dl/865186.html

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FPGA开发

技术资料  CMV2000 datasheet

红外传感器cmv2000用户手册，用于图像采集系统的控制与开发。verilog，cyclone。

https://www.eeworm.com/dl/871298.html

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datasheet 2000

技术资料  基于FPGA的2PSK实现

本代码为基于FPGA的2psk实现，仿真结果正确，采用Verilog硬件描述语言实现！

https://www.eeworm.com/dl/871627.html

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FPGA 2PSK

技术资料  CPLD1270译码器源码

详细的开发板自带的源代码。8位译码器，是verilog入门的基本资料

https://www.eeworm.com/dl/951353.html

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CPLD 1270 译码器

技术资料  m序列

用verilog语言编写的 m序列代码，真真整这个花了功夫的哦，保证十分有用的

https://www.eeworm.com/dl/970406.html

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序列

技术资料  spi_master

使用Verilog HDL 语言实现SPI0 模式0的master模式，其中读、写操作都是低电平

https://www.eeworm.com/dl/972161.html

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spi_master

技术资料  矩阵键盘加减乘除

基于Max+plus2软件的Verilog语言的矩阵键盘的加减乘除级数码管显示

https://www.eeworm.com/dl/982238.html

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矩阵键盘

技术资料  中值滤波器FPGA实现

Verilog实现中值滤波器Median Filter核心代码方便大家做毕设或者工作研究欢迎大家下载

https://www.eeworm.com/dl/983601.html

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FPGA 中值滤波

其他  This document contains a specification for a new low pin count bus interface, dubbed LPC, that will

This document contains a specification for a new low pin count bus interface, dubbed LPC, that will be added to future Intel chip-sets. The target audience for this document are system and component designers.

https://www.eeworm.com/dl/534/242943.html

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specification interface document contains

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