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stratix 的查询结果
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可编程逻辑 基于FPGA的宽带数字接收机变带宽数字下变频器设计
基于FPGA芯片Stratix II EP2S60F672C4设计了一个适用于宽带数字接收机的带宽可变的数字下变频器（VB-DDC）。该VB-DDC结合传统数字下变频结构与多相滤波结构的优点，实现了对输入中频信号的高效高速处理，同时可以在较大范围内对信号处理带宽灵活配置。硬件调试结果验证了本设计的有效性。 ...
可编程逻辑 可重配置PLL使用手册
本文档主要是以Altera公司的Stratix II系列的FPGA器件为例，介绍了其内嵌的增强型可重配置PLL在不同的输入时钟频率之间的动态适应，其目的是通过提供PLL的重配置功能，使得不需要对FPGA进行重新编程就可以通过软件手段完成PLL的重新配置，以重新锁定和正常工作。 ...
DSP编程 在quartusII平台开发的一个交通灯的控制程序
在quartusII平台开发的一个交通灯的控制程序，并在nios平台上可以使用，所用的芯片是Stratix
VHDL/FPGA/Verilog Verilog HDL: Magnitude For a vector (a,b), the magnitude representation is the following: A c
Verilog HDL: Magnitude
For a vector (a,b), the magnitude representation is the following:
A common approach to implementing these arithmetic functions is to use the Coordinate Rotation Digital Computer (CORDIC) algorithm. The CORDIC algorithm calculates the trigonometric functions of sine, cosine ...
VHDL/FPGA/Verilog 这是一个fft的IP核
这是一个fft的IP核，安装要求为quartus6.0以上。解压安装后可在quartus里例化使用，元件主要为cyclone和stratix,最大支持1024点的转换。
加密解密 介绍了3DES加密算法的原理并详尽描述了该算法的FPGA设计实现。采用了状态机和流水线技术
介绍了3DES加密算法的原理并详尽描述了该算法的FPGA设计实现。采用了状态机和流水线技术，使得在面积和速度上达到最佳优化；添加了输入和输出接口的设计以增强该算法应用的灵活性。各模块均用硬件描述语言实现，最终下载到FPGA芯片Stratix EP1S25F780C5中。 ...
VIP专区 VIP专区-3000套PLC实例程序
资源包含以下内容：1.2 COMP CHILLER.rar2.20-COMM-E Adapter Diagnostics.zip3.3 Phase Motor Startup Logic.zip4.500编程实例.rar5.550 OPTICOLOUR MOINITORING TM EDIT.rar6.6688-02.rar7.6[1].下降沿和锁存指令试验.rar8.72 Station Bit Shift PLC Program Triggers 3 Cognex Cameras.zip9.AB 1769-WS称重模块使用程序C ...
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Matlab_2016a 完整破解版下载 使用增强的设计环境和 UI 组件集开发 MATLAB 应用。深度学习用于图像分类问题。访问模板、最新模型以及精选示例。创建包含事件操作和新模块的离散事件模型和调度程序。使用标准座舱仪器显示飞行条件。在线编辑器，用于：开发包含结果和图形以及相关代码的实时脚本创建用于分享的交互式描述， ...