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stm32z编码器增量式 的查询结果
数据结构 实现最优二叉树的构造；在此基础上完成哈夫曼编码器与译码器。 假设报文中只会出现如下表所示的字符： 字符 A B C D E F G H I J K L M N 频度 186 64 13 22
实现最优二叉树的构造；在此基础上完成哈夫曼编码器与译码器。 假设报文中只会出现如下表所示的字符：
字符 A B C D E F G H I J K L M N
频度 186 64 13 22 32 103 21 15 47 57 1 5 32 20 57
字符 O P Q R S T U V W X Y Z ， ．
频度 63 15 1 48 51 80 23 8 18 1 16 1 6 2
要求完成的系统应具备如下的功能：
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语音压缩 java的ilbc语音编码器,实现了其全部功能
java的ilbc语音编码器,实现了其全部功能
数据结构 哈夫曼编_译码器,编码器的实现元代码,数据结构和算法的课程设计,很不错的!
哈夫曼编_译码器,编码器的实现元代码,数据结构和算法的课程设计,很不错的!
VHDL/FPGA/Verilog 用Verilog HDL实现的曼彻斯特编码器和解码器。
用Verilog HDL实现的曼彻斯特编码器和解码器。
书籍源码 H.263编解码源代码 目录中存放的是H.263视频编码器和解码器的程序代码。 播放工具 目录中存放的是用于播放YUV格式视频的工具。 压缩视频 目录中存放的是笔者已压缩好了的263视频数据流文件
\H.263编解码源代码 目录中存放的是H.263视频编码器和解码器的程序代码。
\播放工具 目录中存放的是用于播放YUV格式视频的工具。
\压缩视频 目录中存放的是笔者已压缩好了的263视频数据流文件。
\原始视频 目录中存放的是用于测试用的Demo视频，YUV格式。 ...
通讯/手机编程 BCH编码器并行8路实现
BCH编码器并行8路实现，速率达到300M以上
VHDL/FPGA/Verilog 循环码编码器verilog实现
循环码编码器verilog实现，里面包含有源程序和仿真图。
其他嵌入式/单片机内容 一个QEP电路的verilog代码。输入信号是光电编码器的A相和B相信号和一个处理时钟
一个QEP电路的verilog代码。输入信号是光电编码器的A相和B相信号和一个处理时钟，输出的是计数信号和方向信号。
压缩解压 in 目录下是已编译成功的编解码器程序以及相应说明ldecod 目录下是H.264视频解码器程序代码。lencod 目录下是H.264视频编码器程序代码。 tpdump 目录下是H.264实时传输协
\bin 目录下是已编译成功的编解码器程序以及相应说明\ldecod 目录下是H.264视频解码器程序代码。\lencod 目录下是H.264视频编码器程序代码。\rtpdump 目录下是H.264实时传输协议应用的一个简单例子程序。