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rtl-VCL 的查询结果
Delphi控件源码 smartflash ,delphi vcl组件 ,可以实现透明flash窗体
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VHDL/FPGA/Verilog RTL in Verilog (Vending Machine)
RTL in Verilog (Vending Machine)
Delphi控件源码 VCL component dsplab , STFT and SPECTRUM viewer, real time
VCL component dsplab , STFT and SPECTRUM viewer, real time
源码 Abakus.VCL.v4.90.1
Abakus.VCL.v4.90.1 破解，好用
技术资料 电子书-RTL Design Style Guide for Verilog HDL540页
电子书-RTL Design Style Guide for Verilog HDL540页A FF having a fixed input value is generated from the description in the upper portion of
Example 2-21. In this case, ’0’ is output when the reset signal is asynchronously input,
and ’1’ is output when the START signal rises. Therefore, the FF da ...
技术资料 利用SystemverilogUVM搭建SOC及ASIC的RTL的验证环境
该文档为利用SystemverilogUVM搭建SOC及ASIC的RTL的验证环境讲解文档，是一份很不错的参考资料，具有较高参考价值，感兴趣的可以下载看看………………
技术资料 MDIO Verilog RTL代码，SOC可以通过MDIO接口来访问外部PHY等慢速外设
MDIO Verilog RTL代码，SOC可以通过MDIO接口来访问外部PHY等慢速外设
精品软件 PRECISION RTL V2005B.1100
Actel公司与Mentor Graphics公司日前推出Mentor Graphics的Precision RTL综合工具最新版本。该版本利用Actel基于闪存的ProASIC Plus家族FPGA产品以提供更高的设计性能。
学术论文 多功能车辆总线控制器的FPGA设计与开发.rar
随着计算机网络与嵌入式控制技术的迅速发展，作为传统运输行业的铁路系统对此也有了新的要求，列车通信网络应运而生。经过多年的发展，国际电工委员会(IEC)为了规范列车通信网络，于1999年通过了IEC61375-1标准。该标准将列车通信网络分为两条总线：绞线式列车总线(WTB)和多功能车辆总线(MVB)。MVB是一个标准通信介质，为挂 ...