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技术资料  IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件: module

IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件:module i2c_dri&nbsp; &nbsp; #(&nbsp; &nbsp; &nbsp; parameter&nbsp; &nbsp;SLAVE_ADDR = 7&#39;b1010000&nbsp; &nbsp;,&nbsp; //EEPROM从机地址&nbsp; &nbsp; &nbsp; parameter&nbsp; &nbsp;CLK_FREQ&nbsp; &nbsp;= 26&#39;d50_000_000, //模块输入的时钟频率 ...

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源码  USB、模拟器

mkbus&nbsp; 一、安装原版程序安装文件；二、安装 HASPEmulPE-XP_2_33_a002W .EXE&nbsp; 三、运行 KEYGEN.EXE&nbsp; 四、导入密狗注册表文件和上步生成的注册表文件 haspemul.reg 五、运行第 2 步安装的 HASP Emulator PE V2.33&nbsp; 六、启动 HASP &nbsp;Emulator PE V2.33 后点击左边第一个按钮“HASP ...

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技术资料  AC220V转DC(12V15W )电源板AD设计硬件原理图+PCB文件 2层板设计大小为100

AC220V转DC(12V15W )电源板AD设计硬件原理图+PCB文件，2层板设计，大小为100*55mm,&nbsp; &nbsp;ALTIUM设计的原理图+PCB文件，可以做为你的学习设计参考。主要器件型号如下：Library Component Count : 24Name&nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; Description--------------------------------------- ...

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技术资料  ad9280_9708 ADDA模块硬件资料+PDF原理图+AD PADS CADENCE3中格式原

ad9280_9708 ADDA模块硬件资料+PDF原理图+AD、PADS、CADENCE3中格式原理图库PCB封装库文件:原理图库：Library Component Count : 41Name&nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; &nbsp; Description----------------------------------------------------------------------------------------------------AD8065 ...

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技术资料  FPGA片内FIFO读写测试Verilog逻辑源码Quartus工程文件+文档说明使用 FPGA

FPGA片内FIFO读写测试Verilog逻辑源码Quartus工程文件+文档说明，使用 FPGA 内部的 FIFO 以及程序对该 FIFO 的数据读写操作。FPGA型号Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。timescale 1ns / 1ps//////////////////////////////////////////////////////////////////////////////////module fifo_test( input c ...

https://www.eeworm.com/dl/747455.html

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技术资料  ADS8329 Verilog fpga 驱动源码 2.7V 至 5.5V 16 位 1MSPS 串

ADS8329 Verilog fpga 驱动源码，2.7V 至 5.5V 16 位 1MSPS 串行模数转换器 ADC芯片ADS8329数据采集的verilog代码，已经用在工程中，可以做为你的设计参考。( input clock,&nbsp; input timer_clk_r, input reset,&nbsp; output reg sample_over,&nbsp; output reg ad_convn,&nbsp; input ad_eocn,&nbsp; output reg ad_csn ...

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技术资料  FPGA Verilog HDL设计温度传感器ds18b20温度读取并通过lcd1620和数码管显示

FPGA Verilog HDL设计温度传感器ds18b20温度读取并通过lcd1620和8位LED数码管显示的QUARTUS II 12.0工程文件，包括完整的设计文件.V源码，可以做为你的学习及设计参考。module ds18b20lcd1602display ( Clk, Rst,&nbsp; &nbsp; &nbsp; DQ,&nbsp; &nbsp;//18B20数据端口 Txd,&nbsp; //串口发送端口 LCD_Data, //lcd LCD ...

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技术资料  spi 通信的master部分使用的verilog语言实现

spi 通信的master部分使用的verilog语言实现，可以做为你的设计参考。module spi_master(rstb,clk,mlb,start,tdat,cdiv,din, ss,sck,dout,done,rdata);&nbsp; &nbsp; input rstb,clk,mlb,start;&nbsp; &nbsp; input [7:0] tdat;&nbsp; //transmit data&nbsp; &nbsp; input [1:0] cdiv;&nbsp; //clock divider input din; ou ...

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技术资料  verilog实现I2C通信的slave模块源码状态机设位计可做I2C接口的仿真模型

verilog实现I2C通信的slave模块源码状态机设位计可做I2C接口的仿真模型//`timescale 1ns/1psmodule I2C_slv (input [6:0] slv_id,input&nbsp; &nbsp; &nbsp; &nbsp;RESET,input&nbsp; &nbsp; &nbsp; &nbsp;scl_i,&nbsp; &nbsp; &nbsp; //I2C clkinput&nbsp; &nbsp; &nbsp; &nbsp;sda_i,&nbsp; &nbsp; &nbsp; //I2C data ini ...

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技术资料  IIC接口E2PROM(AT24C64) 读写VERILOG 驱动源码+仿真激励文件: module

源码  USB、模拟器

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