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其他 SD card controller can just read data using 1 bit SD mode. I have written this core for NIOS2 CPU,
SD card controller can just read data using 1 bit SD mode.
I have written this core for NIOS2 CPU, Cyclone, but I think it can works
with other FPGA or CPLD. Better case for this core is SD clock = 20 MHz and
CPU clock = 100 MHz (or in the ratio 1:5). If you have a wish you can achieve this core.
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技术资料 基于NIOS软核处理器的FPGA嵌入式片上系统中的MP3算法
·基于NIOS软核处理器的FPGA嵌入式片上系统中的MP3算法
技术资料 基于Nios的聚类向量ARMA轴温探测器--列车轴温探测系统的信号处理
· 摘要：  阐述了在向量ARMA(Auto-Regressive Moving Average,自回归滑动平均)模型中的聚类算法,介绍了使用Altera DSP Builder和SOPC Builder实现聚类向量自回归滑动平均的卡尔曼最优平滑滤波器的设计方法,给出了聚类向量ARMA卡尔曼最优平滑滤波器的设计框图,比较了32阶FIR(Finite Impulse Respons ...
单片机开发 ic卡控制器24c01在软核处理器nios上的底层驱动程序
ic卡控制器24c01在软核处理器nios上的底层驱动程序
软件工程 在de2板上的led流水灯显示 C语言实现 实验环境Quartus2+nios2
在de2板上的led流水灯显示 C语言实现 实验环境Quartus2+nios2
嵌入式/单片机编程 该程序是在NIOS II环境下运行的 使用LWIP协议栈实现了HTTP协议的接受请求 SOCKET编程
该程序是在NIOS II环境下运行的 使用LWIP协议栈实现了HTTP协议的接受请求 SOCKET编程
其他嵌入式/单片机内容 DDS发生器NIOS .c文件,在NIOSII中可以配合Verilog代码生成的自定义外设产生DDS信号
DDS发生器NIOS .c文件,在NIOSII中可以配合Verilog代码生成的自定义外设产生DDS信号
VHDL/FPGA/Verilog 是Nios II處理器下客製化指令的一個32位元浮點數除法器
是Nios II處理器下客製化指令的一個32位元浮點數除法器，可將兩IEEE 754格式的值進行相除
嵌入式/单片机编程 UART nios中文使用说明,使用的是uart的控制的基本指令而不是用的基本输入输出命令
UART nios中文使用说明,使用的是uart的控制的基本指令而不是用的基本输入输出命令
嵌入式/单片机编程 基于fpga和sopc的用VHDL语言编写的EDA的32位Nios CPU嵌入式系统软硬件设计
基于fpga和sopc的用VHDL语言编写的EDA的32位Nios CPU嵌入式系统软硬件设计