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教程资料 多个Verilog和vhdl程序例子
多个Verilog和vhdl程序例子，可以作为初学者参考实例，按照电路结构写出HDL代码
教程资料 fpga-jpeg-verilog在fpga平台使用verilog语言进行jpeg算法实现
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Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，单片机进行计算和显示。
教程资料 verilog HDL 编写的PWM
verilog HDL 编写的PWM，是初学CPLD者入门Z资源，epm7128stc100-10
教程资料 dds设计，生成多种波形，Verilog语言
dds设计，花了一个星期做的,verilog写的，可生成多种波形，频率范围可上M,性能不错。
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教程资料 verilog 编写的I2c协议程序
verilog 编写的I2c协议程序，用于cpld读写EEPROM
教程资料 实现音乐播放的FPGA的实验源码（Verilog语言）
这是一个FPGA的实验源码，可以实现对一段音乐的播放。用Verilog语言编写的，对初学者会有一定的帮助。
教程资料 基于Verilog HDL语言的FPGA源程序
本原码是基于Verilog HDL语言的FPGA原程序，主要用于测频率，特点主要是可以更快地测频。实时性更高。
教程资料 采用Verilog语言,实现了FPGA控制视频芯片的数据采集,并将数据按帧存储起来
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