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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.4 脉冲频率的测量与显示 9.4.1 脉冲频率的测量原理 9.4.2 频率计的工作原理 9.4.3 频率测量模块的设计与实现
基于Verilog-HDL的硬件电路的实现
9.4 脉冲频率的测量与显示
9.4.1 脉冲频率的测量原理
9.4.2 频率计的工作原理
9.4.3 频率测量模块的设计与实现
9.4.4 while循环语句的使用方法
9.4.5 门控信号发生模块的设计与实现
9.4.6 频率计的Verilog-HDL描述
9.4.7 频率计的硬件实现 ...
VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.5 脉冲周期的测量与显示 9.5.1 脉冲周期的测量原理 9.5.2 周期计的工作原理 9.5.3 周期测量模块的设计与实现
基于Verilog-HDL的硬件电路的实现
9.5 脉冲周期的测量与显示
9.5.1 脉冲周期的测量原理
9.5.2 周期计的工作原理
9.5.3 周期测量模块的设计与实现
9.5.4 forever循环语句的使用方法
9.5.5 disable禁止语句的使用方法
9.5.6 时标信号发生模块的设计与实现
9.5.7 周期计的Verilog-HDL描述 ...
VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.6 脉冲高电平和低电平持续时间的测量与显示 9.6.1 脉冲高电平和低电平持续时间测量的工作原理 9.6.2 高低电平持续时间测量模
基于Verilog-HDL的硬件电路的实现
9.6 脉冲高电平和低电平持续时间的测量与显示
9.6.1 脉冲高电平和低电平持续时间测量的工作原理
9.6.2 高低电平持续时间测量模块的设计与实现
9.6.3 改进型高低电平持续时间测量模块的设计与实现
9.6.4 begin声明语句的使用方法
9.6.5 initial语句和always语句 ...
VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.7 步进电机的控制 9.7.1 步进电机驱动的逻辑符号 9.7.2 步进电机驱动的时序图 9.7.3 步进电机驱动的逻辑框图
基于Verilog-HDL的硬件电路的实现
9.7 步进电机的控制
9.7.1 步进电机驱动的逻辑符号
9.7.2 步进电机驱动的时序图
9.7.3 步进电机驱动的逻辑框图
9.7.4 计数模块的设计与实现
9.7.5 译码模块的设计与实现
9.7.6 步进电机驱动的Verilog-HDL描述
9.7.7 编译指令-"宏替换`define"的使用 ...
VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.8 基于256点阵的汉字显示 9.8.1 单个静止汉字显示的设计原理及其仿真实现 9.8.2 单个静止汉字显示的硬件实现 9
基于Verilog-HDL的硬件电路的实现
9.8 基于256点阵的汉字显示
9.8.1 单个静止汉字显示的设计原理及其仿真实现
9.8.2 单个静止汉字显示的硬件实现
9.8.3 多个静止汉字显示的设计原理及其硬件实现
9.8.4 单个运动汉字显示的设计原理及其硬件实现
9.8.5 多个运动汉字显示的设计原理及其硬件实现 ...
VHDL/FPGA/Verilog 基本运算逻辑和它们的Verilog HDL模型
基本运算逻辑和它们的Verilog HDL模型
其他 disable mouse for access program
disable mouse for access program
其他书籍 Verilog.pdf。有Verilog的大量范例。适合于想动手设计芯片的人。
Verilog.pdf。有Verilog的大量范例。适合于想动手设计芯片的人。
VHDL/FPGA/Verilog 原创VERILOG HDL 实现CACHE的操作
原创VERILOG HDL 实现CACHE的操作，有需要请下载
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