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modelSim-win 的查询结果
书籍源码 夏宇闻8位RISC_CPU的完整代码+TESTBENCH（已调试） modelsim工程文件
夏宇闻8位RISC_CPU的完整代码+TESTBENCH（已调试）
modelsim工程文件，包括书中所测试的三个程序和相关数据，绝对可用~所有信号名均遵从原书。在论坛中没有找到testbench的，只有一个mcu的代码，但很多和书中的是不一样的，自己改了下下~`````大家多多支持啊~`我觉得书中也还是有些不尽如人意的地方，如clk_gen.v中clk2,clk ...
VHDL/FPGA/Verilog modelsim注册license解码解码
modelsim注册license解码解码
Linux/Unix编程 IO ZONE,大名鼎鼎的文件系统性能测试软件的源代码.C写的,LINUX和WIN下都可以用
IO ZONE,大名鼎鼎的文件系统性能测试软件的源代码.C写的,LINUX和WIN下都可以用
VHDL/FPGA/Verilog Modelsim DDR2 SDRAM files
Modelsim DDR2 SDRAM files
VHDL/FPGA/Verilog it is a verilog code written for MAX1886 ADC interin modelsim simulator and it will synthesize in x
it is a verilog code written for MAX1886 ADC interin modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit.
VHDL/FPGA/Verilog it is a verilog code written for digital watch in modelsim simulator and it will synthesize in xin
it is a verilog code written for digital watch in modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit.[i mae my own kit for spartan2 device]
VHDL/FPGA/Verilog it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix ise 8
it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit.[i mae my own kit for spartan2 device].you can use this code in any DSP project in which data entry is required.
驱动编程 完整的基于Conxant平台的USB电视棒的WIN驱动程序。
完整的基于Conxant平台的USB电视棒的WIN驱动程序。
FlashMX/Flex源码 典型实例13SDRAM读写控制的实现与Modelsim仿真
典型实例13SDRAM读写控制的实现与Modelsim仿真
编译器/解释器 WIN-TC 中文版 可以黏贴复制
WIN-TC 中文版 可以黏贴复制，使用方便！！！！！！！！！！