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VHDL/FPGA/Verilog 这是一个用MAX+PLUSII开发FPGA（1K30器件）开发的李沙育图形发生器（硬件描述语言部分）。

这是一个用MAX+PLUSII开发FPGA（1K30器件）开发的李沙育图形发生器（硬件描述语言部分）。

https://www.eeworm.com/dl/663/140872.html

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其他  3d max 作业这是一个简单的作业3d max 作业3d max 作业

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https://www.eeworm.com/dl/534/145437.html

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其他  3d max 作业这是用3D MAX 做的一个沙发还不错

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VHDL/FPGA/Verilog 大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟

大学vhdl语言实验大全,基于max-plus2平台,内有8-3译码器,8位加法器,数字钟，数码显示，74ls138，8，4位计数器，d，rs触发器，加法器，交通灯等，此原码基于长江大学可编程器件实验箱,如要运行在其他平台上需要重新定义管脚

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生物技术  The software package provides a MAX-MIN Ant System implemented in the Hyper-Cube Framework for the

The software package provides a MAX-MIN Ant System implemented in the Hyper-Cube Framework for the application to Unconstrained Binary Quadratic Programming (UBQP).

https://www.eeworm.com/dl/670/152307.html

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其他  基于max plus2的ahdl语言。这个是键盘扫描程序的ahdl。文件格式是tdf。可以扫描键盘。

基于max plus2的ahdl语言。这个是键盘扫描程序的ahdl。文件格式是tdf。可以扫描键盘。

https://www.eeworm.com/dl/534/156453.html

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其他  这个是max plus2的7段数码管的扫描程序。文件格式为hif

这个是max plus2的7段数码管的扫描程序。文件格式为hif，介绍7段数码管的设计方法。你好，管理员，我十分需要贵网站的一个程序，请为我开通下载。我会尽力上传源码，支持网站的发展。

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VHDL/FPGA/Verilog Altera MAX II 开发板原理图

Altera MAX II 开发板原理图

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VHDL/FPGA/Verilog max+plusII下编成的直流电机控制器vhd

max+plusII下编成的直流电机控制器vhd

https://www.eeworm.com/dl/663/162460.html

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VHDL/FPGA/Verilog max+plusII下的使用列举类型的状态机

max+plusII下的使用列举类型的状态机

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