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技术资料 基于FPGA的多通道工频场强监测分析研究.rar
随着国民经济的飞速发展，城市用电负荷不断增长，高压输变电设备在为城市供电的同时，其产生的电磁场也带来了大量的电磁污染。电磁污染不仅影响周围电气设备的正常工作，而且危害人们的安全健康，因此高压架空线的铺设和变电站的设计必须充分考虑到电磁污染的影响和对其的抑制。 为了更好的保障人们的健康安全，维护电网的 ...
VIP专区 VIP专区-嵌入式/单片机编程源码精选合集系列（139）
VIP专区-嵌入式/单片机编程源码精选合集系列（139）资源包含以下内容：1. NIOS_II.2. 复杂模型机的设计与实现 组成原理的课程设计.3. 北京理工大学嵌入式系统的课件.4. 一個自己寫的簡單員工管理系統.5. 32位嵌入式系统实现.6. i2c总线的CPLD程序.7. mDOC在C语言环境下的驱动开发程序.8. 凯恩帝继电器版的PCB原文件。可以用 ...
学术论文 基于DSP和ARM的电能质量监测系统
随着电力电子技术的广泛应用，电能污染日益严重，电能质量已成为电力部门及用户日益关注的问题。电能质量的好坏直接关系国民经济的总体效益，对电能质量进行监测与分析从而提高和改善电能质量具有重要的现实意义。 本文根据IEC和国家标准，并且经过对国内外电能质量研究现状及同类产品进行认真分析的基础上，主要针对我国电 ...
学术论文 1553B总线接口技术研究及实现
本文在深入研究MIL-STD-1553B总线传输协议以及国外协议芯片设计方法的基础上，结合目前较流行的EDA技术，基于Xilinx公司Virtex-II系列FPGA完成了1553B总线接口协议设计实现，并自行设计实验板将所做的设计进行了验证。论文从专用芯片实现的具体功能出发，结合自顶向下的设计思想，给出基于FPGA的总线接口协议设计的总体方案 ...
教程资料 Xilinx FPGA全局时钟资源的使用方法
目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构 ...
可编程逻辑 Xilinx FPGA全局时钟资源的使用方法
目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构 ...
技术资料 IGBT模块的尔应用手册(图文版)
IGBT模块的一些基本知识2·怎样读数据手册3.IGBT的驱动电路4，电压尖峰吸收回路5·短路6，IGBT模块的可靠性和实效分析7，仿真软件Melcosim的使用方法8.一些注意事项正的门极电压推荐15V（±10%）如右图所示Vog越高Vceat和Eon越小，损耗减小。但是16.5V以上的话短路耐量很小。所以正的门极电压为+15v±10%最合适。负的门极电 ...
技术资料 FPGA的水声OFDM系统设计讲解
该文档为基于FPGA的水声OFDM系统设计讲解文档，文介绍了一种用FPGA实现对高速A／D转换芯片的控制电路，讨论了这一控制电路设计思
想，提出了更好地解决高速A／D采样与较慢速的单片机数据处理间矛盾的链接方法。 关键词 高速A／D转换，单片机，FIFO引言对A／D器件进行采样控制，传统的方法多数是用CPU或单片机完成的。 ...
技术资料 1553B总线接口技术研究及实现
本文在深入研究MIL-STD-1553B总线传输协议以及国外协议芯片设计方法的基础上，结合目前较流行的EDA技术，基于Xilinx公司Virtex-II系列FPGA完成了1553B总线接口协议设计实现，并自行设计实验板将所做的设计进行了验证。论文从专用芯片实现的具体功能出发，结合自顶向下的设计思想，给出基于FPGA的总线接口协议设计的总体方案 ...
技术资料 基于FPGA的同步数字复接系统的设计.rar
数字复接技术是数字通信网的一项重要技术，能够将若干路低速信号合并为一路高速信号，进而提高传输效率。应用可编程逻辑门阵列(FPGA)芯片实现复接系统便于修改电路结构，增强设计的灵活性，并且节约了系统资源。 本文基于FPGA的同步数字复接系统的设计与建模，首先介绍了EDA技术及其发展，然后对数字复接技术的基木原理进行 ...