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hdl 的查询结果
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教程 verilog hdl设计参考
Verilog黄金参考指南
Verilog基础知识
Verilog练习题
其他 riscv课程设计报告
riscv课程设计报告，用 Verilog HDL 语言实现一个五级流水线的 RISC-V 的指令子集，并在仿真软件上加载要求的测试程序和数据，仿真结果正确。只设计 CPU 流水线，不要求设计 Cache 控制器（即不考虑 cache 相联关系）。 CPU中需要的I-Cache，D-Cache用两个有 ...
教程 ARM M0实验报告
用 verilog HDL 语言搭建一个以 ARM Cortex-M0 为处理器核的嵌入式SOC系统,系统包含以下几个部分： 
(1)ARM Cortex-M0核 
(2)AHB总线译码器 
(3)AHB总线从设备多路复用器 
(4)片上存储器外设 
(5)LED外设 
(6)七段数码管 
(7)定时器 
(8)UART& ...
教程 Altium_Designer_Winter_09_教程_(PDF版)
Altium Designer 基于一个软件集成平台，把为电子产品开发提供完整环境所需的工具全部整合在一个应用软件中。
Altium Designer 包含所有设计任务所需的工具：原理图和HDL 设计输入、电路仿真、信号完整性分析、PCB 设计、基于FPGA 的嵌入式系统设计和开发。另外可对Altium Designer 工作环境加以定制，以满足用户的各种不同 ...
技术资料 华为FPGA设计规范 VERILOG约束 编程规范时序分析等全套资料: FPGA技巧Xilinx.p
华为FPGA设计规范 VERILOG约束 编程规范时序分析等全套资料:FPGA技巧Xilinx.pdfHuaWei Verilog 约束.rarSynplify工具使用指南(华为文档)[1].rar.rarVerilog HDL 华为入门教程.rarVerilog典型电路设计 华为.rar一种将异步时钟域转换成同步时钟域的方法.pdf华为coding style.rar华为FPGA设计流程指南.doc华为FPGA设计规范.rar ...
技术资料 IEEE_Verilog_2001
The Verilog Hardware Description Language (HDL) is defined in this standard. Verilog HDL is a formal notation intended for use in all phases of the creation of electronic systems. Because it is both machine readable and human readable,it supports the development,verification, synthesis,and testing o ...
技术资料 ABEL硬件程序设计
硬件描述语言（英文： Hardware Description Language ，简称： HDL ）是电子系统硬件行为描述、结构描述、数据流描述的语言。利用这种语言，数字电路系统的设计可以从顶层到底层（从抽象到具体）逐层描述自己的设计思想，用一系列分层次的模块来表示极其复杂的数字系统。然后，利用电子设计自动化（ EDA ）工具，逐层进行 ...