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教程资料 基于QUARTUSII软件 实现FPGA（ATERA CYCLONE II系列）与SD卡SD模式通信源码
基于QUARTUSII软件 实现FPGA（ATERA CYCLONE II系列）与SD卡SD模式通信\r\n所用语言位verilog HDL
VHDL/FPGA/Verilog 有两个
有两个，一个用VHDL编写的I2C，一个Verilog hdl语言编写的
VHDL/FPGA/Verilog 本程序为24小时计时器
本程序为24小时计时器，稳定无误差。简单好用，是Verilog HDL语言初学者的指引。
技术资料 VHDLcksc.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDLcksc.pdf
技术资料 Vhdl学习.zip
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->Vhdl学习.zip
技术资料 VHDLsDecodersSkeleton.pdf
资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->VHDLsDecodersSkeleton.pdf