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fpga-sdram 的查询结果
软件设计/软件工程 针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA)
针对主控制板上存储器(SRAM) 存储的数据量小和最高频率低的情况,提出了基于SDR Sdram(同步动态RAM) 作为主存储器的LED 显示系统的研究。在实验中,使用了现场可编程门阵列( FPGA) 来实现各模块的逻辑功能。最终实现了对L ED 显示屏的控制,并且一块主控制板最大限度的控制了256 ×128 个像素点,基于相同条件,比静态内存控制的 ...
其他 sdram接口的vhdl实现,适用于lattice的FPGA
sdram接口的vhdl实现,适用于lattice的FPGA，内含状态机和各个模块的具体实现
VHDL/FPGA/Verilog FPGA设计的SDRAM控制器
FPGA设计的SDRAM控制器，有仿真代码，已通过验证
VHDL/FPGA/Verilog DDR2 SDRAM 控制器的FPGA实现
DDR2 SDRAM 控制器的FPGA实现
VHDL/FPGA/Verilog 这个是一个基于FPGA的SDRAM控制器系统
这个是一个基于FPGA的SDRAM控制器系统，实现对SDRAM的读写操作，用来实现时序的控制
VHDL/FPGA/Verilog 使用Verilog实现基于FPGA的SDRAM控制器
使用Verilog实现基于FPGA的SDRAM控制器
VHDL/FPGA/Verilog FPGA读写SDRAM的VHDL程序
FPGA读写SDRAM的VHDL程序，已经测试过
VHDL/FPGA/Verilog 基于FPGA的SDRAM控制器Verilog代码
基于FPGA的SDRAM控制器Verilog代码，开发环境为Quartus6.1，控制SDRAM实现对同一片地址先写后读。
技术资料 基于FPGA的SDRAM控制器的设计与实现简介
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技术资料 基于FPGA设计的sdram读写测试实验Verilog逻辑源码Quartus工程文件+文档说明 DR
基于FPGA设计的sdram读写测试实验Verilog逻辑源码Quartus工程文件+文档说明，DRAM选用海力士公司的 HY57V2562 型号,容量为的 256Mbit,采用了 54 引脚的TSOP 封装, 数据宽度都为 16 位, 工作电压为 3.3V,并丏采用同步接口方式所有的信号都是时钟信号。FPGA型号Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。timescale 1ps ...