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VHDL/FPGA/Verilog 采用fpga的hdl语言实现dds的信号发生器的设计

采用fpga的hdl语言实现dds的信号发生器的设计，性能与传统相比明显提高。

https://www.eeworm.com/dl/663/438682.html

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技术资料  STM32控制液晶12864显示开机画面，多级菜单，配置ADC,DAC,DDS

STM32控制液晶12864显示开机画面，多级菜单，配置ADC,DAC,DDS

https://www.eeworm.com/dl/857184.html

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STM32 液晶12864

技术资料  一种基于DDS芯片AD9835的多种信号发生器

本文介绍用89C51单片微机控制直接数字频率合成器（ＤＤＳ）芯片AD9835设计的高精度多种信号发生器，着重讨论了AD9835基本工作原理、与89C51接口，单片微机控制系统的硬件结构及软件设计框图。

https://www.eeworm.com/dl/886574.html

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9835 AD

技术资料  ad9910 DDS板 VHDL源代码，在Cyclone II FPGA上调试通过

ad9910 DDS板 VHDL源代码，在Cyclone II FPGA上调试通过

https://www.eeworm.com/dl/890327.html

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ad9910 dds vhdl fpga

技术资料  fpga VHDL语言，控制DDS产生频率可变的正弦波信号扫频

fpga VHDL语言，控制DDS产生频率可变的正弦波信号扫频

https://www.eeworm.com/dl/893213.html

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fpga vhdl dds

技术资料  DDS芯片AD9850的工作原理及其与单片机的接口

介绍了美国AD公司采用先进的直接数字频率合成(DDS)技术推出的高集成度频率合成器AD9850的工作原理、主要特点及其与MCS51单片机的接口,并给出了接口电路图和部分源程序.

https://www.eeworm.com/dl/916740.html

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9850 AD

单片机开发  DDS数字信号发生器,采用AD9835DDS 专用芯片输出范围1K--10MHZ 采用X25045作看门狗及数据存储器

DDS数字信号发生器,采用AD9835DDS 专用芯片输出范围1K--10MHZ 采用X25045作看门狗及数据存储器，用于设置各项参数的存储内含电路图，源程序及一些相关资料

https://www.eeworm.com/dl/648/141406.html

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DDS X25045 9835 MHZ

VHDL/FPGA/Verilog DDS的vhdl语言源程序实现该程序可实现1HZ频率步进

DDS的vhdl语言源程序实现该程序可实现1HZ频率步进

https://www.eeworm.com/dl/663/138696.html

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vhdl DDS 1HZ 语言

VHDL/FPGA/Verilog dds的IP CORE,你可以根据你自己的需求定制它的数据宽度.

dds的IP CORE,你可以根据你自己的需求定制它的数据宽度.

https://www.eeworm.com/dl/663/182094.html

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CORE dds 定制数据

通讯/手机编程  生成4种方式的DDS输出的读表程序的VHDL源代码程序。

生成4种方式的DDS输出的读表程序的VHDL源代码程序。

https://www.eeworm.com/dl/527/204957.html

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