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Xilinx-XUPV 的查询结果
源码 ml505开发板驱动200Mhz的sdram
xilinx的ml505开发板驱动SDRAM例程
软件 vivado2019 license
vivado2019 license,可以破解xilinx的开发工具vivodo2019
书籍 Spartan-6用户手册
XILINX的sp6实用手册,自己看吧,挺不错的!!!!!
技术资料 FPGA自学米尔 Xilinx zynq7020开发板全套资料链接
资料共5G,Zynq 7020平台,包括FPGA、SDK源码,例程源码,各种图像处理,人工智能算法,原理图,PCB,适合做项目移植、项目开发
技术资料 MYD-Y7Z010 007S开发板 用户 手
MYD-Y7Z010/007S开发板 开发板 由 MYC-Y7Z010/007S核心板 加 MYB-Y7Z010/007S底板 组成 。核心板 核心板 采用了 Xilinx最新的基于 最新的基于 最新的基于 28nm工艺的 工艺的 Zynq-7000 All Programmable SoC平 台, 集成了 集成了 单/双核 ARM Cortex-A9处理器和 处理器和 处理器和 FPGA,具有 高性能,低功耗 高性能,低功 ...
技术资料 vivado集成开发环境时序约束介绍
本文主要介绍如何在Wado设计套件中进行时序约束,原文出自 xilinx中文社区。1 Timing Constraints in Vivado-UCF to xdcVivado软件相比于sE的一大转变就是约束文件,5E软件支持的是UcF(User Constraints file,而 Vivado软件转换到了XDc(Xilinx Design Constraints)。XDC主要基于SDc(Synopsys Design Constraints)标准 ...
技术资料 FPGA开发全攻略(下册)
FPGA开发全攻略(下册) 如何克服 FPGA I/O 引脚分配挑战 作者:Brian Jackson  产品营销经理Xilinx, Inc.  brian.jackson@xilinx.com 对于需要在 PCB 板上使用大规模 FPGA 器件的设计人员来说,I/O 引脚分配是必须面对的众多挑战之一。  由于众多原因,许多设计人员发表为大型 FPGA 器件和高级 BGA 封装确定 ...
技术资料 915MHz超高频RFID阅读器射频前端电路设计
为了提高超高频RFID系统中阅读器在低信噪比的情况下仍具有较高的识别能力,提出一种基于FPGA系统结合软件无线电方法实现超高频RFID射频前端电路方案。超高频射频识别系统必须符合EPC Class 1generation 2标准,所设计的电路系统以Xilinx公司的XC6SLX16-2CSG324FPGA芯片为硬件基础,将数字基带调制解调和中频滤波电路在FPGA系统 ...
技术资料 《FPGA应用开发入门与典型实例》 pdf 华清远见10年特献版
逻辑器件分成两类:① 固定的或定制的。② 可编程的或可变的。其中,固定的或定制的逻辑器件通常称为专用芯片(ASIC)。ASIC 是为了满足特定的用途而设计的芯片,例如 MP3 解码芯片等。其优点是通过固化的逻辑功能和大规模的工业化生产,降低了芯片的成本,同时提高了产品的可靠性。随着集成度的提高,ASIC 的物理尺寸也在 ...
技术资料 FPGA核心知识详解与开发技巧-完整版.docx
FPGA核心知识详解与开发技巧对初级FPGA工程师而言,必须掌握FPGA相关基础知识、精通硬件描述语言、熟练数字电路设计、加强工程项目的实践。应广大初级FPGA工程师/FPGA爱好者之需,电子发烧友网策划整合并隆重推出FPGA核心知识详解与开发技巧电子书,以后会陆续推出其他章节,敬请广大工程师朋友继续关注和留意。目录1、FPGA ...