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Verilog HDL 的查询结果
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VHDL/FPGA/Verilog 以前在学校里的课程设计
以前在学校里的课程设计，使用verilog编写的一个CPU程序，可以下板子
其他 ALTERA上DE2平台
ALTERA上DE2平台，verilog描述，无符号乘法器，在数码管显示结果。
VHDL/FPGA/Verilog 6级流水
6级流水，verilog实现浮点数的加法，其中浮点数格式符合IEEE754标准
VHDL/FPGA/Verilog 从MIC输入一段音频然后
从MIC输入一段音频然后，再从AOUT的接口播放出来的verilog 的代码
VHDL/FPGA/Verilog 本实验实现一个能显示小时
本实验实现一个能显示小时，分钟，秒的数字时钟（贝一特电子）Verilog源码
其他 十字路口交通灯控制:分为主路和辅路
十字路口交通灯控制:分为主路和辅路，由verilog实现
技术资料 基于CPLD器件的线型CCD东芝TCD1501的驱动程序
基于CPLD器件的线型CCD东芝TCD1501的驱动程序，用verilog语言开发。
技术资料 基于FPGA嵌入式系统设计（第二版）配套代码
《基于FPGA嵌入式系统设计》（第二版）的配套代码，verilog编写带工程。