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Verilog 的查询结果
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VHDL/FPGA/Verilog AVS运动补偿电路的VLSI设计与实现 提出了一种基于AVS标准的高效的运动补偿电路硬件结构
AVS运动补偿电路的VLSI设计与实现
提出了一种基于AVS标准的高效的运动补偿电路硬件结构，该设计采用了8 X 8块级流
水线操作，运动矢量归一化处理和插值滤波器组保证了流水线的高效运行以及硬件资源的最优
利用。采用Verilog语言完成了VLSI设计，并通过EDA软件给出仿真和综合结果。 ...
其他 设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟
设计一个能进行时、分、秒计时的十二小时制或二十四小时制的数字钟，并具有定时与闹钟功能，能在设定的时间发出闹铃音，能非常方便地对小时、分钟和秒进行手动调节以校准时间，每逢整点，产生报时音报时。实验平台： 1. 一台PC机； 2. MAX+PLUSII10.1。 Verilog HDL语言实现 ...
技术资料 高性能FPGA的典型应用领域
目前以硬件描述语言(Verilog 或 VHDL)所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC 设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路(比如AND、OR、XOR、NOT)或者更复杂一些的组合功能比如解码器或数学方程式。在大多数的FPGA里面 ...
技术教程 华为内部资料大全2-1
华为 FPGA设计高级技巧Xilinx篇.pdf
华为 Verilog基本电路设计指导书.pdf
华为 大规模逻辑设计指导书.pdf
RD_射频基础知识培训.pdf
华为C语言编程规范总则.pdf
华为EMC资料-94页-2.5M.PDF
华为笔试题大全（史上最齐全）.doc
华为模拟电路上册-117页-1.1M-pdf版.pdf
华为模拟电路下册-82页-1.0M-pdf版.pdf ...
教程资料 基于NiosII软核处理器的步进电机接口设计
    NiosII软核处理器是Altera公司开发，基于FPGA操作平台使用的一款高速处理器，为了适应高速运动图像采集，提出了一种基于NiosII软核处理的步进电机接口设计，使用verilog HDL语言完成该接口设计，最后通过QuartusII软件，给出了实验仿真结果。
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可编程逻辑 基于NiosII软核处理器的步进电机接口设计
    NiosII软核处理器是Altera公司开发，基于FPGA操作平台使用的一款高速处理器，为了适应高速运动图像采集，提出了一种基于NiosII软核处理的步进电机接口设计，使用verilog HDL语言完成该接口设计，最后通过QuartusII软件，给出了实验仿真结果。
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其他书籍 IP核生成器生成 ip 后有两个文件对我们比较有用
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则
asyn_fifo.veo 给出了例化该核方式（或者在 Edit－>Language Template->COREGEN 中找到
verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库
的模块，仿真时该文件也要加入工程。 ...
软件工程 在微型计算机系统中, CPU与外部的基本通信方式有两种,一种是并行通信即数据的各位同 时传送,其优点是传输速度较快,但数据有多少位就需要多少条传送线 而串行通信中数据一位一位顺序传 送,能节省传送
在微型计算机系统中, CPU与外部的基本通信方式有两种,一种是并行通信即数据的各位同
时传送,其优点是传输速度较快,但数据有多少位就需要多少条传送线 而串行通信中数据一位一位顺序传
送,能节省传送线. 用Verilog HDL语言实现了串并、并串通信接口之间的转换 ...
VHDL/FPGA/Verilog 文章介绍了系统的硬件电路原理与具体实现方法
文章介绍了系统的硬件电路原理与具体实现方法，其中主要包括载波恢
复电路，PN 码捕获电路和跟踪电路，并针对Xilinx 公司FPGA 的特点，对各电
路的实现进行优化设计，在不影响系统稳定性和精度的前提下，减少硬件资源
消耗，提高硬件利用率。设计利用Verilog 硬件描述语言完成，通过后仿真验证
电路正确性，并给出综合结果 ...
源码 eda大作业 简易计算器
在掌握常用数字电路功能和原理的基础上，根据EDA技术课程所学知识，利用硬件描述语言Verilog HDL、EDA软件Quartus II和硬件平台Cyclone/Cyclone
II FPGA进行电路系统的设计。本次实验我完成的内容是简单计算器的设计