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加密解密  伪随机序列产生器－线性反馈移位寄存器

伪随机序列产生器－线性反馈移位寄存器，Verilog HDL 原代码。

https://www.eeworm.com/dl/519/374702.html

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伪随机序列产生器线性反馈移位寄存器

嵌入式/单片机编程  FIFO级联

FIFO级联，利用verilog语言实现Xilinx FIFO18单元的多个级联，增大FIFO深度。

https://www.eeworm.com/dl/647/397391.html

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FIFO 级联

串口编程  带有自适应功能的UART

带有自适应功能的UART，是用VERILOG编写的源码，包括测试文件，与大家分享

https://www.eeworm.com/dl/624/444540.html

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UART

串口编程  很好用的串口通讯程序

很好用的串口通讯程序，已经通过验证，用Verilog语言编写的放心使用了！

https://www.eeworm.com/dl/624/466179.html

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串口通讯程序

VHDL/FPGA/Verilog 8051内核的设计

8051内核的设计，用Verilog硬件描述语言实现，在modelsim环境下进行仿真。

https://www.eeworm.com/dl/663/470562.html

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8051 内核

技术资料  CCD驱动源码

线阵CCD的驱动时序产生，针对TCD1703。基于FPGA开发，使用verilog HDL语言。

https://www.eeworm.com/dl/864412.html

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CCD verilogHDL TCD1703

技术资料  FPGA流水灯实验

利用Verilog语言编写的流水灯实验，实验采用芯片EP2C8Q208

https://www.eeworm.com/dl/869933.html

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Verilog EP2C8Q208

技术资料  FPGA ComplierII V3.80

FPGA ComplierII,VHDL/Verilog综合软件，Synopsys公司将停止发展FPGAexpress软件，而转到FPGA ComplierII平台

https://www.eeworm.com/dl/928454.html

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ComplierII FPGA 3.80

技术资料  fpga uart

fpga verilog 模拟uart收发器，已在最高波特率115200下测试通过

https://www.eeworm.com/dl/967175.html

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fpga uart

技术资料  卷积编码

介绍了常用的（2,1,7）编码，代码用比较流行的verilog语言描述的

https://www.eeworm.com/dl/969260.html