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VHDL/FPGA/Verilog 将正弦波分割

将正弦波分割，数字化处理，即dds技术，为verilog做准备

https://www.eeworm.com/dl/663/238126.html

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正弦波分割

并行计算  PCI-master的核

PCI-master的核，verilog语言，经测试，可完成芯片的综合及布线

https://www.eeworm.com/dl/694/254964.html

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PCI-master

VHDL/FPGA/Verilog 64位乘法器

64位乘法器，超前进位的，大家看看，通过仿真的，verilog的

https://www.eeworm.com/dl/663/264378.html

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乘法器

VHDL/FPGA/Verilog 自己写的一个pwm模块

自己写的一个pwm模块，verilog的，是用于无刷电机控制的。

https://www.eeworm.com/dl/663/286747.html

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pwm 模块

VHDL/FPGA/Verilog 和NIOS功能一样的CPU

和NIOS功能一样的CPU，可以在FPGA上运行,Verilog源代码

https://www.eeworm.com/dl/663/333195.html

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NIOS CPU

嵌入式/单片机编程  就是个译码器

就是个译码器，用cpld实现的译码器是verilog写的

https://www.eeworm.com/dl/647/351875.html

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译码器

VHDL/FPGA/Verilog spi总线控制器

spi总线控制器，包含vhdl和verilog两种代码方式来实现。

https://www.eeworm.com/dl/663/355974.html

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spi 总线控制器

通讯/手机编程  单级cic数字积分梳妆滤波器实现

单级cic数字积分梳妆滤波器实现，格式.v代码，verilog语言编程

https://www.eeworm.com/dl/527/367791.html

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cic 数字积分滤波器

VHDL/FPGA/Verilog 串口实验

串口实验，很好用，我还有verilog HDL VHDL CPLD EPM1270 源代码

https://www.eeworm.com/dl/663/370394.html

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串口实验

单片机开发  mcu与cpld之间spi接口程序

mcu与cpld之间spi接口程序，mcu为master，cpld用verilog写成slave模块

https://www.eeworm.com/dl/648/374655.html

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cpld mcu spi 接口程序

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