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VHDL/FPGA/Verilog AVS运动补偿电路的VLSI设计与实现提出了一种基于AVS标准的高效的运动补偿电路硬件结构

AVS运动补偿电路的VLSI设计与实现提出了一种基于AVS标准的高效的运动补偿电路硬件结构，该设计采用了8 X 8块级流水线操作，运动矢量归一化处理和插值滤波器组保证了流水线的高效运行以及硬件资源的最优利用。采用Verilog语言完成了VLSI设计，并通过EDA软件给出仿真和综合结果。 ...

https://www.eeworm.com/dl/663/227026.html

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其他嵌入式/单片机内容  verilog编写

verilog编写，rtl风格，流水线设计，实现图像rgb格式到yuv格式的转换。

https://www.eeworm.com/dl/687/227301.html

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VHDL/FPGA/Verilog 在利用Verilog在FPGA平台上输出正弦波

在利用Verilog在FPGA平台上输出正弦波，实现芯片为Cyclone II 484C8，有管脚分配

https://www.eeworm.com/dl/663/227577.html

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系统设计方案  本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用

本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用，通过硬件描述语言VERILOG在ISE中实现电路生成，采用MODELSIM、SYNPLIFY工具分别进行仿真和综合。 ...

https://www.eeworm.com/dl/678/228649.html

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软件工程  Verilog语法手册

Verilog语法手册，7件逻辑的实现与实验练习，非常实用，对学习Verilog编程很有帮助。

https://www.eeworm.com/dl/540/229512.html

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VHDL/FPGA/Verilog verilog源代码

verilog源代码，quartusII工程。程序实现VGA时序。控制VGA显示器输出图形。在quartusII中客直接运行，

https://www.eeworm.com/dl/663/237695.html

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VHDL/FPGA/Verilog 离散余弦变换的verilog源代码

离散余弦变换的verilog源代码，经过验证可实现

https://www.eeworm.com/dl/663/245300.html

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VHDL/FPGA/Verilog jpeg格式到bmp格式的硬件实现

jpeg格式到bmp格式的硬件实现，verilog开发，fpga 实现。

https://www.eeworm.com/dl/663/249359.html

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VHDL/FPGA/Verilog 自己编写的串口UART发送的Verilog模块。与FIFO连接

自己编写的串口UART发送的Verilog模块。与FIFO连接，可以实现自动连续发送。

https://www.eeworm.com/dl/663/251468.html

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VHDL/FPGA/Verilog Verilog 程序

Verilog 程序，实现4阶 fir-filter滤波器。

https://www.eeworm.com/dl/663/254063.html

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