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VHDL/FPGA/Verilog mcs51的vhdl IP核,是每个学习FPGA的必经之路
mcs51的vhdl IP核,是每个学习FPGA的必经之路，希望一起探讨
文件格式 文章详细介绍了VHDL中状态机的设计,结合图形解释,对于初学者很有帮助
文章详细介绍了VHDL中状态机的设计,结合图形解释,对于初学者很有帮助
文章/文档 设计ip协议的vhdl实现
设计ip协议的vhdl实现，对作通讯硬件的朋友因该有所帮助
其他 若干VHDL语言的源代码
若干VHDL语言的源代码，我觉得应该用用仅供参考
其他书籍 VHDL的数字设计与综合的经典图书
VHDL的数字设计与综合的经典图书，与大家共享
编辑器/阅读器 SOURCE INSIGHT的VHDL语法插件
SOURCE INSIGHT的VHDL语法插件，SOURCE INSIGHT支持自动完成等功能，是一个不错的硬件语言编辑分析器
VHDL/FPGA/Verilog 3X3矩阵乘法的VHDL程序实现！对初学者有很大的帮助！
3X3矩阵乘法的VHDL程序实现！对初学者有很大的帮助！
VHDL/FPGA/Verilog USB的vhdl代码
USB的vhdl代码，具有很强的指导意义，对FPGA进行usb控制很有帮助！
其他嵌入式/单片机内容 一个用VHDL语言编写的全加器
一个用VHDL语言编写的全加器，是数字电路EDA设计的一个例子，可能不太特别，但是应该可以用一下的。
系统设计方案 用VHDL结构描述设计一全减器
用VHDL结构描述设计一全减器，全减器可由两个半减器和一个或门组成。