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VHDL-CPLD 的查询结果
嵌入式/单片机编程 本设计的基本要求是以复杂可编程逻辑器件CPLD为基础
本设计的基本要求是以复杂可编程逻辑器件CPLD为基础，通过在EDA系统软件ispDesignExpert System 环境下进行数字系统设计，熟练掌握该环境下的功能仿真，时间仿真，管脚锁定和芯片下载。 本系统基本上比较全面的模拟了计数式数字频率计，广泛应用于工业、民用等各个领域，具有一定的开发价值。 ...
VHDL/FPGA/Verilog 用VHDL编写DDR SDRAM Controller的源代码
用VHDL编写DDR SDRAM Controller的源代码
VHDL/FPGA/Verilog 本程序使用vhdl编写的jtag接口实现程序,其中有些功能未能实现,希望有人能够帮忙完善!
本程序使用vhdl编写的jtag接口实现程序,其中有些功能未能实现,希望有人能够帮忙完善!
VHDL/FPGA/Verilog VHDL学习手册
VHDL学习手册
嵌入式/单片机编程 嵌入式可编程器件CPLD的典型实例 压缩包
嵌入式可编程器件CPLD的典型实例 压缩包，共计43个源码文件。 使用ALTERA的 Muxplus 软件即可编辑仿真 相关软件可在教育网ftp下载[天网查询，有很多站点提供]
VHDL/FPGA/Verilog 几个VHDL的源代码和和一个本人编写的5级流水线RISC CPU的代码
几个VHDL的源代码和和一个本人编写的5级流水线RISC CPU的代码
VHDL/FPGA/Verilog 可综合的vhdl设计特点.pdf
可综合的vhdl设计特点.pdf
嵌入式/单片机编程 JTAG仿真器CPLD
JTAG仿真器CPLD
VHDL/FPGA/Verilog 1024点FFT快速傅立叶变换,(vhdl代码)
1024点FFT快速傅立叶变换,(vhdl代码)
VHDL/FPGA/Verilog 8255参考设计VHDL源代码
8255参考设计VHDL源代码